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这是一个Verilog HDL编写的RISC cpu的程序

VHDL/FPGA/Verilog 44 K 138 次下载 2015-03-26

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RAR

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44 K

资源分类

VHDL/FPGA/Verilog

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2015-03-26 20:03

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这是一个Verilog HDL编写的RISC cpu的程序 - 资源详细说明

这是一个Verilog HDL编写的RISC cpu的程序，该程序共10个子程序，实现了简单的RISC cpu，可供初学者参考，学习硬件描述语言，及设计方法。该程序通过了modelsim仿真验证。

这是一个Verilog HDL编写的RISC cpu的程序 - 源码文件列表

本资源包含 47 个源码文件支持在线预览，点击文件名即可查看

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verilog.asm

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_primary.dat

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_primary.vhd

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verilog.asm

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_primary.dat

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_primary.vhd

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_info

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verilog.asm

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_primary.dat

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_primary.vhd

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verilog.asm

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_primary.dat

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_primary.vhd

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verilog.asm

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_primary.dat

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