💻 VerilogHDL_advanced_digital_design_code_Ch6 Verilog HDL 高级数字设计源码ch6 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 for_and_loop_comb.v
284 B
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2
📄 mux_reg.v
351 B
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3
📄 addvb_models_6.doc
0 B
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4
📄 ripple_counter.v
832 B
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5
📄 nrz_2_manchester_mealy.v
1.17 KB
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6
📄 bcd_to_excess_3c_post.v
1.38 KB
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7
📄 test_count_ones_d.v
614 B
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8
📄 count_ones_d.v
865 B
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9
📄 test_count_ones_c.v
609 B
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10
📄 nrzi.v
1.88 KB
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11
📄 bcd_to_excess_3b.v
1.7 KB
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12
📄 bcd_to_excess_3a.v
1022 B
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13
📄 test_count_ones_a.v
576 B
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14
📄 or_nand.v
156 B
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15
📄 or4_behav_latch.v
405 B
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16
📄 count_ones_b2.v
767 B
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17
📄 seq_rec_moore_imp.v
1.1 KB
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18
📄 count_ones_b.v
2.77 KB
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19
📄 latch_if1.v
296 B
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20
📄 latch_if2.v
285 B
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21
📄 shifter_1.v
593 B
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22
📄 bcd_to_excess_3b_post.v
2.12 KB
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23
📄 count_ones_imp.v
971 B
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24
📄 test_count_ones_sd.v
815 B
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25
📄 test_count_ones_sm.v
806 B
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26
📄 bi_dir_bus.v
460 B
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27
📄 nrz_2_manchester_moore_post.v
612 B
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28
📄 uni_dir_bus.v.doc
0 B
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29
📄 add_accum_2.v
381 B
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30
📄 seq_rec_3_1s_moore.v
2.15 KB
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31
📄 nrz_2_manchester_mealy_post.v
1.07 KB
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32
📄 test_count_ones_b.v
746 B
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33
📄 seq_rec_3_1s_mealy.v
2.17 KB
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34
📄 boole_opt.v
345 B
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35
📄 d_reg4_a.v
328 B
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36
📄 latched_seven_seg_display.v
1.46 KB
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37
📄 count_ones_sd.v
1.22 KB
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38
📄 count_ones_sd_0.v
1.43 KB
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39
📄 expression_sub_nb.v
509 B
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40
📄 for_and_loop_comb.v
257 B
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41
📄 mux_reg.v
257 B
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42
📄 addvb_models_6.doc
453 B
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43
📄 ripple_counter.v
257 B
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44
📄 nrz_2_manchester_mealy.v
258 B
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45
📄 bcd_to_excess_3c_post.v
258 B
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46
📄 test_count_ones_d.v
257 B
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47
📄 count_ones_d.v
257 B
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48
📄 test_count_ones_c.v
257 B
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49
📄 nrzi.v
258 B
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50
📄 bcd_to_excess_3b.v
258 B
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