or_nand.v

来自「VerilogHDL_advanced_digital_design_code_」· Verilog 代码 · 共 8 行

8 行

module or_nand (y, enable, x1, x2, x3, x4);
  output y;
  input 	enable, x1, x2, x3, x4;

  assign y = ~(enable & (x1 | x2) & (x3 | x4));
endmodule

or_nand.v - 源码说明

本页面展示了「VerilogHDL_advanced_digital_design_code_Ch6 Verilog HDL 高级数字设计源码ch6」中的 or_nand.v 源码文件，采用 Verilog 编程语言编写，共 8 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

虫虫开发者社区收录了大量与VerilogHDL相关的技术资源，包括源代码、技术文档、电路图等，是电子工程师和嵌入式开发者的专业学习平台。

⌨️ 快捷键说明

复制代码Ctrl + C

搜索代码Ctrl + F

全屏模式F11

增大字号Ctrl + =

减小字号Ctrl + -

显示快捷键?