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v-hdl技术资料
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用HDL语言编写的通用fifo源码
用HDL语言编写的通用fifo源码，通过对fifo的宽度和深度进行配置，可以产生我们所需要的fifo，还包括fifo的测试程序和仿真Makefile脚本...
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Arbiter.v verilog实现 三路请求，使用循环策略的仲裁器 含有看门狗电路...
中文版Verilog HDL简明教程 第1章 简介 第2章 HDL指南 第3章 Verilog语言要素 第4章 表 达 式 第5章 门电平模型化
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用Verilog HDL 语言编写的播放梁祝的程序
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基于地址总线接口的四倍频编码器信号接口的 FPGA实现 Verilog HDL的
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ITU-T RECOMMENDATION V.250 SERIAL ASYNCHRONOUS AUTOMATIC DIALLING AND CONTROL 99年5月版本
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hdl的8051核
hdl的8051核，不知道好不好用大家试试吧。xilinx公司的核...