Verilog+VHDL

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500

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Verilog HDl代码，学习一颗看一下

2013-08-19 113 Verilog+VHDL

verilog源代码，quartusII工程。程序实现VGA时序。控制VGA显示器输出图形。在quartusII中客直接运行，

2013-12-19 155 Verilog+VHDL

2014-07-30 185 Verilog+VHDL

Verilog HDL课件，有常见问题说明

2013-12-21 69 Verilog+VHDL

2014-01-25 50 Verilog+VHDL

verilog实现shiftreg，带测试文件。文件相當完整，可以下載去測試

2016-02-06 151 Verilog+VHDL

8051core-Verilog编写，可修改

2016-02-27 137 Verilog+VHDL

2013-12-29 174 Verilog+VHDL

Verilog的教程，对学习erilog的是一个很不错的选择

2013-12-06 92 Verilog+VHDL

基于Verilog实现的UART通信模块，包含时钟分频与收发逻辑，结构清晰便于移植，适用于数字系统设计与串口通信开发。

2026-03-04 1 Verilog+VHDL