VeriLog HDL语言 xilinx ISE 10.1,高教仪EXCD-1FPGA电路板
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VeriLog HDL语言 xilinx ISE 10.1,高教仪EXCD-1FPGA电路板
一个类似涂鸦跳跃的小游戏,开发调试所用的板子为spartan-6。压缩包内有全部.v源代码文件,4个coe文件(用以制作4个rom),1个说明文件。使用需将板子链接vga及ps/2键盘(开发时用的是usb接口的键盘)。
第一章 数字信号处理、计算、程序、 算法和硬线逻辑的基本概念 第二章 Verilog HDL设计方法概述 第三章 Verilog HDL的基本语法 第四章 不同抽象级别的Verilog HDL模型 第五章 基本运算逻辑和它们的Ve...
·详细说明:已经验证过的ITU G.729B源码 1.使用定点运算, 纯c实现 2.已经附带了VC6的项目文件(原始的ITU源码只有makefile,没有VC项目文件), 方便初学者入门使用 3.用于测试G.729编码和解码 4...
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The code assumes a two-dimensional computational domain with TMz polarization (i.e., non-zero field Ez, Hx, and Hy). The...