Verilog+Code
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查看全部 500 份 →FIFO的Verilog程序 已在modelsim中编译通过 并且可以通过DC进行综合
FIFO的Verilog程序 已在modelsim中编译通过 并且可以通过DC进行综合
2015-11-22
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verilog语言编写的FPGA代码。功能为pc机通过epp不断写数到sram中
verilog语言编写的FPGA代码。功能为pc机通过epp不断写数到sram中，然后pc发送中断信号打断写过程读取sram中的数据。rar包中包含epp协议，模块文件和测试文件（test）。
2013-12-17
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