VHDL-AMS
VHDL-AMS是VHDL的一个分支,它支持模拟、数字、数模混合电路系统的建模与仿真。
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VHDL数字钟
用vhdl实现数字钟 其一,具有时,分,秒计数显示功能,其中,要求以二十四小时循环及 时; 其二,具有清零,调节小时,分钟功能; 其三,具有整点报时功能,而...
2015-06-24
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