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用vhdl实现秒表的功能,具有秒表功能,有分、秒显示,后期可以自己添加闹钟的模块。
用VHDL语言实现电子钟
VHDL语言实现的UART IP核,比较实用
用VHDL实现四位乘法器,不直接用乘法实现,一来节省资源,二来可提高速度!
VHDL实现的桶型移位器,能在一个时钟周期实现对数据的(0-12位)算术右移
VHDL语言写的IIC实现EEPROM,很好的程序,已经用过,没有问题
vhdl实现的三人表决器,大家一起交流一下,
VHDL实现 DDS。大家共享吧,一起学习,一起进步
在FPGA上实现的圆发生器设计,包括原理说明,采样数据获取,最终VHDL源代码设计。
VHDL实现的8位乘法器,所有仿真全部通过
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