关于在FPGA或CPLD锁相环PLL原理与应用,介绍用FPGA的分频技术.
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pll算法是来自经典的DSP的C程序和汇编程序库...
对于如何设计数字PLL的参数很有帮助. 分析了在最小等效噪声带宽,最小相位均方误差,以及最短锁定时间三种意义上的参数优化设计...
This example sets up the PLL in x10/2 mode, divides SYSCLKOUT by six to reach a 25Mhz HSPCLK (assuming a 30Mhz XCLKIN). The clock divider in the ADC...
《锁相环(PLL)电路设计与应用》内容丰富、实用性强,便于读者自学与阅读理解,可供电子、通信等领域技术人员以及大学相关专业的本科生、研究生参考,也可供广大的电子爱好者学习参考。...