Modelsim+FPGA

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用FPGA为核心器件,用VHDL为设计手段设计并制作一个用于棋类比赛的计时钟系统，功能要求如下： 1. 该计时钟可分别完成甲乙对规定用时的计时和规定时间用完后的读秒计时。 2. 规定甲乙双方各有1小时比赛规定用时，分别设计各方的用时定时...

2026-03-20 2 Modelsim+FPGA

采用FPGA实现高精度频率测量，基于Verilog硬件描述语言设计，支持多通道信号采集与实时处理。系统具备良好的可扩展性与稳定性，适用于科研与工业测试场景。

2026-03-22 3 Modelsim+FPGA