FPGA译码

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用VHDL编译的源代码，模拟心脏跳动，解压后直接用Quartus打开project即可，不好意思刚才第一个那个模拟心脏跳动（heartbeat）的源程序发错了，请删除，

2014-01-10 26 FPGA译码

用VHDL编译的源代码，4bit加一器，输入一个4位二进制数自动加一，解压后直接用Quartus打开project即可

2016-11-27 25 FPGA译码

用VHDL编译的源代码，两位优先级编码器，输入一个十进制数，直接显示头两个‘1’所在的位，解压后直接用Quartus打开project即可

2016-11-27 146 FPGA译码

· 摘要：  主要介绍卷积编码器和Vertibi译码器的基本原理.对用TMS320C54X DSP来实现Vertibi译码器中的两个主要环节--度量值更新和回溯,作了详细说明,并给出具体的实现程序. &nbsp...

2024-06-06 2 FPGA译码