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利用vhdl语言编写百进制计数器（程序代码）...

📅 2018-12-20

学习7段数码显示译码器、十六进制计数器以及顶层连接模块的Verilog设计； 2、掌握组合逻辑，时序逻辑以及用例化语句实现顶层模块的Verilog设计方法； 3、熟悉QuartusⅡ的...

📅 2019-05-30

M进制可逆计数器的设计、仿真及实验...

📅 2013-10-17

该程序实现的是10进制的计数器，具有置位复位的功能。...

📅 2015-04-18

24,60,100进制的计数器，还有数字时钟，欢迎下载哦~...

📅 2013-12-07

该代码是100进制可逆计数器的源代码，已经在软件上调试过了，比较有用的...

📅 2015-08-23

带左拐的交通灯设计与25进制的加法计数器，Maxplus2软件中的Verilog语言编写...

📅 2015-10-08

60进制加法计数器设计时主要采用数电知识，采用清零法和反馈置数法进行电路设计。用两片74161，采用反馈清零法进行电路设计，此时相当于设计两个加法计数器，左边的是高位片，此时的高位片在电路中相当于是一...

📅 2017-05-21

使用VHDL实现16进制的计数器的算法程序...

📅 2013-12-06

1.七段数码管译码器 2.4人表决器 3.4进制加减法计数器~具有进位和借位功能...

📅 2013-12-20

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