c8051120锁相环，定时器3的初始化和使用
上传时间： 2014-01-16
上传用户：xiaoyunyun
本程序是利用两个4位二进制并行加法器通过级联方式构成一个8位加法器。
上传时间： 2014-11-29
上传用户：270189020
捷联惯导四元数转换误差分析捷联惯导算法方面学习资料
上传时间： 2016-05-28
上传用户：luopoguixiong
捷联惯导系统航向姿态计算算法研究学习文献
上传时间： 2013-12-24
上传用户：星仔
FPGA弹弓无线呼叫系统分发射和接收两大部分。发射部分采用锁相环式频率合成器技术
上传时间： 2016-05-29
上传用户：youmo81
这是锁相环芯片MC145170程序，单片机是用at89s52的
上传时间： 2013-12-18
上传用户：youmo81
操作系统中避免死锁——银行家算法的实现。
上传时间： 2016-06-01
上传用户：AbuGe
用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.
上传时间： 2016-06-04
上传用户：ls530720646
该原代码包括捷联惯导姿态程序,位置程序以及初始对准程序,实用性强,便于学习.
上传时间： 2013-12-10
上传用户：lifangyuan12
简述了V HDL 语言的功能及其特点,并以 8 位串行数字锁设计为例,介绍了在Max + plus Ⅱ10. 2 开发软件下,利用V HDL 硬件描述语言设 计数字逻辑电路的过程和方法。并设计了密码锁
上传时间： 2013-12-23
上传用户：yimoney
