虫虫首页| 资源下载| 资源专辑| 精品软件
登录| 注册

移<b>位寄存器</b>

  • 汇编语言教程.rar

    一本很好的汇编语言教程,跟大家一起分享 课程介绍 第1章 预备知识  1.1 汇编语言的由来及其特点   1 机器语言   2 汇编语言   3 汇编程序   4 汇编语言的主要特点   5 汇编语言的使用领域  1.2 数据的表示和类型   1 数值数据的表示   2 非数值数据的表示   3 基本的数据类型  1.3 习题 第2章 CPU资源和存储器  2.1 寄存器组   1 寄存器组   2 通用寄存器的作用   3 专用寄存器的作用  2.2 存储器的管理模式   1 16位微机的内存管理模式   2 32位微机的内存管理模式  2.3 习题 第3章 操作数的寻址方式  3.1 立即寻址方式  3.2 寄存器寻址方式  3.3 直接寻址方式  3.4 寄存器间接寻址方式  3.5 寄存器相对寻址方式  3.6 基址加变址寻址方式  3.7 相对基址加变址寻址方式  3.8 32位地址的寻址方式  3.9 操作数寻址方式的小结  3.10 习题 第4章 标识符和表达式  4.1 标识符  4.2 简单内存变量的定义   1 内存变量定义的一般形式   2 字节变量   3 字变量   4 双字变量   5 六字节变量   6 八字节变量   7 十字节变量  4.3 调整偏移量伪指令   1 偶对齐伪指令   2 对齐伪指令   3 调整偏移量伪指令   4 偏移量计数器的值  4.4 复合内存变量的定义   1 重复说明符   2 结构类型的定义   3 联合类型的定义   4 记录类型的定义   5 数据类型的自定义  4.5 标号  4.6 内存变量和标号的属性   1 段属性操作符   2 偏移量属性操作符   3 类型属性操作符   4 长度属性操作符   5 容量属性操作符   6 强制属性操作符   7 存储单元别名操作符  4.7 表达式   1 进制伪指令   2 数值表达式   3 地址表达式  4.8 符号定义语句   1 等价语句   2 等号语句   3 符号名定义语句  4.9 习题 第5章 微机CPU的指令系统  5.1 汇编语言指令格式   1 指令格式   2 了解指令的几个方面  5.2 指令系统   1 数据传送指令   2 标志位操作指令   3 算术运算指令   4 逻辑运算指令   5 移位操作指令   6 位操作指令   7 比较运算指令   8 循环指令   9 转移指令   10 条件设置字节指令   11 字符串操作指令   12 ASCII-BCD码调整指令   13 处理器指令  5.3 习题 第6章 程序的基本结构  6.1 程序的基本组成   1 段的定义   2 段寄存器的说明语句   3 堆栈段的说明   4 源程序的结构  6.2 程序的基本结构   1 顺序结构   2 分支结构   3 循环结构  6.3 段的基本属性   1 对齐类型   2 组合类型   3 类别   4 段组  6.4 简化的段定义   1 存储模型说明伪指令   2 简化段定义伪指令   3 简化段段名的引用  6.5 源程序的辅助说明伪指令   1 模块名定义伪指令   2 页面定义伪指令   3 标题定义伪指令   4 子标题定义伪指令  6.6 习题 第7章 子程序和库  7.1 子程序的定义  7.2 子程序的调用和返回指令   1 调用指令   2 返回指令  7.3 子程序的参数传递   1 寄存器传递参数   2 存储单元传递参数   3 堆栈传递参数  7.4 寄存器的保护与恢复  7.5 子程序的完全定义   1 子程序完全定义格式   2 子程序的位距   3 子程序的语言类型   4 子程序的可见性   5 子程序的起始和结束操作   6 寄存器的保护和恢复   7 子程序的参数传递   8 子程序的原型说明   9 子程序的调用伪指令   10 局部变量的定义  7.6 子程序库   1 建立库文件命令   2 建立库文件举例   3 库文件的应用   4 库文件的好处  7.7 习题 第8章 输入输出和中断  8.1 输入输出的基本概念   1 I/O端口地址   2 I/O指令  8.2 中断   1 中断的基本概念   2 中断指令   3 中断返回指令   4 中断和子程序  8.3 中断的分类   1 键盘输入的中断功能   2 屏幕显示的中断功能   3 打印输出的中断功能   4 串行通信口的中断功能   5 鼠标的中断功能   6 目录和文件的中断功能   7 内存管理的中断功能   8 读取和设置中断向量  8.4 习题 第9章 宏  9.1 宏的定义和引用   1 宏的定义   2 宏的引用   3 宏的参数传递方式   4 宏的嵌套定义   5 宏与子程序的区别  9.2 宏参数的特殊运算符   1 连接运算符   2 字符串整体传递运算符   3 字符转义运算符   4 计算表达式运算符  9.3 与宏有关的伪指令   1 局部标号伪指令   2 取消宏定义伪指令   3 中止宏扩展伪指令  9.4 重复汇编伪指令   1 伪指令REPT   2 伪指令IRP   3 伪指令IRPC  9.5 条件汇编伪指令   1 条件汇编伪指令的功能   2 条件汇编伪指令的举例  9.6 宏的扩充   1 宏定义形式   2 重复伪指令REPEAT   3 循环伪指令WHILE   4 循环伪指令FOR   5 循环伪指令FORC   6 转移伪指令GOTO   7 宏扩充的举例   8 系统定义的宏  9.7 习题 第10章 应用程序的设计  10.1 字符串的处理程序  10.2 数据的分类统计程序  10.3 数据转换程序  10.4 文件操作程序  10.5 动态数据的编程  10.6 COM文件的编程  10.7 驻留程序  10.8 程序段前缀及其应用   1 程序段前缀的字段含义   2 程序段前缀的应用  10.9 习题 第11章 数值运算协处理器  11.1 协处理器的数据格式   1 有符号整数   2 BCD码数据   3 浮点数  11.2 协处理器的结构  11.3 协处理器的指令系统   1 操作符的命名规则   2 数据传送指令   3 数学运算指令   4 比较运算指令   5 超越函数运算指令   6 常数操作指令   7 协处理器控制指令  11.4 协处理器的编程举例  11.5 习题 第12章 汇编语言和C语言  12.1 汇编语言的嵌入  12.2 C语言程序的汇编输出  12.3 一个具体的例子  12.4 习题 附录

    标签: 汇编语言 教程

    上传时间: 2013-07-05

    上传用户:hw1688888

  • 基于FPGA的通用异步收发器的设计.rar

    通用异步收发器(Universal Asynchronous Receiver Transmitter,UART)是一种能同时支持短距离和长距离数据传输的串行通信接口,被广泛应用于微机和外设之间的数据交换。像8251、NS8250、NS16550等都是常用的UART芯片,但是这些专用的串行接口芯片的缺点是数据传输速率比较慢,难以满足高速率数据传输的场合,而更重要的就是它们都具有不可移植性,因此要利用这些芯片来实现PC机和FPGA芯片之间的通信,势必会增加接口连线的复杂程度以及降低整个系统的稳定性和有效性。 本课题就是针对UART的特点以及FPGA设计具有可移植性的优势,提出了一种基于FPGA芯片的嵌入式UART设计方法,其中主要包括状态机的描述形式以及自顶向下的设计方法,利用硬件描述语言来编制UART的各个子功能模块以及顶层模块,之后将其集成到FPGA芯片的内部,这样不仅能解决传统UART芯片的缺点而且同时也使整个系统变得更加具有紧凑性以及可靠性。 本课题所设计的LIART支持标准的RS-232C传输协议,主要设计有发送模块、接收模块、线路控制与中断仲裁模块、Modem控制模块以及两个独立的数据缓冲区FIFO模块。该模块具有可变的波特率、数据帧长度以及奇偶校验方式,还有多种中断源、中断优先级、较强的抗干扰数据接收能力以及芯片内部自诊断的能力,模块内分开的接收和发送数据缓冲寄存器能实现全双工通信。除此之外最重要的是利用IP模块复用技术设计数据缓冲区FIFO,采用两种可选择的数据缓冲模式。这样既可以应用于高速的数据传输环境,也能适合低速的数据传输场合,因此可以达到资源利用的最大化。 在具体的设计过程中,利用Synplify Pro综合工具、ModelSim仿真工具、ISE集成的软件开发环境中对各个功能模块进行综合优化、仿真验证以及下载实现。各项数据结果表明,本课题中所设计的UART满足预期设计目标。

    标签: FPGA 异步收发器

    上传时间: 2013-08-02

    上传用户:rocketrevenge

  • 基于FPGA的软件无线电数字接收机的研究.rar

    在现代电子系统中,数字化已经成为发展的必然趋势,接收机数字化是电子系统数字化中的一项重要内容,对数字化接收机的研究具有重要的意义。随着数字化理论和微电子技术的迅速发展,高速的中频数字化接收机的实现已经成为可能。本文研究了一种基于FPGA的软件无线电数字接收平台的设计,并着重研究了其中数字中频处理单元的设计和实现。FPGA器件具有设计灵活、开发周期短和开发成本低等优点,所以广泛应用于各种通信系统中。相比于传统的DSP串行结构,FPGA能够进行流水线性设计,对数据进行并行处理,所以FPGA在进行数据量大,要求实时处理的系统设计时有很大的优势。 本文首先首先分析了软件无线电当前的发展趋势及技术现状,针对存在的处理速度跟不上的DSP瓶颈问题,提出了中频软件无线电的FPGA实现方案。本文以FPGA实现为重点,在深入分析软件无线电相关理论的基础上,着重研究和完成了中频软件无线电数字接收平台两大模块的FPGA实现:数字下变频相关模块和数字调制解调模块。其中,在深入研究数字下变频实现结构的基础上,首先对数字下变频模块的数控振荡器(NCO)采用了直接频率合成技术(DDS)实现,其频率分辨率高,灵活,易于实现;高效抽取滤波器组由积分梳状滤波器(CIC),半带滤波器(HB),FIR滤波器组成。对积分梳状滤波器(CIC)本文采用了Hogenaur“剪除”理论对内部寄存器的位宽进行改进,极大地节约了资源,提高了运行速率。对FIR滤波器和半带滤波器采用了(DA)分布式算法,它的运行速度只与数据的宽度有关,只有加减法运算和二进制除法,既缩减了系统资源又大大节省了运算时间,实现了高效的实时处理。对数字调制解调模块,重点研究和完成了2ASK和2FSK的调制解调的FPGA实现,模块有很好的通用性,能方便地移植到其它的系统中。在文章的最后还对整个系统进行了Matlab仿真,验证了系统设计思想的正确性。在系统各个关键模块的设计过程中,都是先依据一定的设计指标进行verilog编程,然后再在Quartus软件中编译,时序仿真测试,并与Matlab仿真结果进行对比,验证设计的正确性。

    标签: FPGA 软件无线电 数字接收机

    上传时间: 2013-05-18

    上传用户:450976175

  • 基于FPGA的RS255,223编解码器的高速并行实现.rar

    随着信息时代的到来,用户对数据保护和传输可靠性的要求也在不断提高。由于信道衰落,信号经信道传输后,到达接收端不可避免地会受到干扰而出现信号失真。因此需要采用差错控制技术来检测和纠正由信道失真引起的信息传输错误。RS(Reed—Solomon)码是差错控制领域中一类重要的线性分组码,由于它编解码结构相对固定,性能强,不但可以纠正随机差错,而且对突发错误的纠错能力也很强,被广泛应用在数字通信、数据存储系统中,以满足对数据传输通道可靠性的要求。因此设计一款高性能的RS编解码器不但具有很大的应用意义,而且具有相当大的经济价值。 本文首先介绍了线形分组码及其子码循环码、BCH码的基础理论知识,重点介绍了BCH码的重要分支RS码的常用编解码算法。由于其算法在有限域上进行,接着介绍了有限域的有关理论。基于RS码传统的单倍结构,本文提出了一种八倍并行编码及九倍并行解码方案,并用Verilog HDL语言实现。其中编码器基于传统的线性反馈移位寄存器除法电路并进行八倍并行扩展,译码器关键方程求解模块基于修正的欧几里德算法设计了一种便于硬件实现的脉动关键方程求解结构,其他模块均采用九倍并行实现。由于进行了超前运算、流水线及并行处理,使编解码的数据吞吐量大为提高,同时延时更小。 本论文设计了C++仿真平台,并与HDL代码结果进行了对比验证。Verilog HDL代码经过modelsim仿真验证,并在ALTERA STRATIX3 EP3SL15OF1152C2 FPGA上进行综合验证以及静态时序分析,综合软件为QUATURSⅡ V8.0。验证及测试表明,本设计在满足编解码基本功能的基础上,能够实现数据的高吞吐量和低延时传输,达到性能指标要求。本论文在基于FPGA的RS(255,223)编解码器的高速并行实现方面的研究成果,具有通用性、可移植性,有一定的理论及经济价值。

    标签: FPGA 255 223

    上传时间: 2013-04-24

    上传用户:思琦琦

  • MP3音频解码器的FPGA原型芯片设计与实现.rar

    MP3音乐是目前最为流行的音乐格式,因其音质、复杂度与压缩比的完美折中,占据着广阔的市场,不仅在互联网上广为流传,而且在便携式设备领域深受人们喜爱。本文以MPEG-1的MP3音频解码器为研究对象,在实时性、面积等约束条件下,研究MP3解码电路的设计方法,实现FPGA原型芯片,研究MP3原型芯片的验证方法。 论文的主要贡献如下: (1)使用算法融合方法合并MP3解码过程的相关步骤,以减少缓冲区存储单元的容量和访存次数。如把重排序步骤融合到反量化模块,可以减少一半的读写RAM操作;把IMDCT模块内部的三个算法步骤融合在一起进行设计,可以省去存储中间计算结果的缓存区单元。 (2)反量化、立体声处理等模块中,采用流水线设计技术,设置寄存器把较长的组合逻辑路径隔开,提高了电路的性能和可靠性;使用连续访问公共缓存技术,合理规划各计算子模块的工作时序,将数据计算的时间隐藏在访存过程中;充分利用频率线的零值区特性,有效地减少数据计算量,加快了数据处理的速度。 (3)设计了MP3硬件解码器的FPGA原型芯片。采用Verilog HDL硬件描述语言设计RTL级电路,完成功能仿真,以Altera公司Stratix II系列的EP2S180 FPGA开发板为平台,实现MP3解码器的FPGA原型芯片。MP3硬件解码器在Stratix II EP2S180器件内的资源利用率约为5%,其中组合逻辑查找表ALUT为7189个,寄存器共有4024个,系统频率可达69.6MHz,充分满足了MP3解码过程的实时性要求。实验结果表明,MP3音频解码FPGA原型芯片可正常播放声音,解码音质良好。

    标签: FPGA MP3 音频解码器

    上传时间: 2013-07-01

    上传用户:xymbian

  • ARM嵌入式教学实验系统的研究与实现

    ARM嵌入式技术在工业和生活中正得到越来越广泛的应用,为了适应技术的发展和社会的需求,满足为社会培养创新型人才的需要,高校通信类和电子类专业开设ARM嵌入式技术相关课程及其实验课程将成为趋势。在课程中设置合理实验,可以有效提高学生的动手能力和培养创新性思维,帮助学生更快、更好地掌握理论和应用技术。 论文设计的ARM嵌入式教学实验系统包括一块适合普通高校嵌入式技术实验课程教学的实验开发板及其配套的实验。该实验系统针对一般高校所开设的ARM嵌入式技术相关课程的要求而设计,配套实验符合教学大纲及实验课时的要求。 论文设计的实验开发板主要组成模块有:最小系统,包括控制器模块、电源模块、复位模块、Flash ROM模块、SDRAM模块、JTAG接口等;扩展接口,包括LED、键盘、RS232串口、I2C接口、液晶模块、以太网模块等。实验开发板采用S3C4510B网络控制芯片用作控制和信号处理,使用网络接口芯片DM9161和隔离变压器H1102完成网络接入,使用AM29LV160和HY57V641620HG构建16位存储单元,使用AT24C01和PCF8583来构建I2C接口,使用MAX232完成TTL电平转换以扩展RS232串口,并扩展键盘和LCD实现人机交互。实验开发板的硬件设计充分考虑了一般高校实验室的条件和需求,能够较好地将成本控制在150元左右,有利于在有限的条件下为每个学生尽可能的创造动手制作PCB的实验条件。实验板的接口设计能够让学生较为方便地开展实验,并考虑了实验板扩展和二次开发的需要。 论文设计的实验系统配套实验主要有基础实验、扩展实验和设计实验。基础实验主要帮助学生熟悉嵌入式系统的片内资源和特殊功能寄存器的配置方法,对整个嵌入式系统的架构有一定的理解,能编程完成一些简单的控制功能;扩展实验主要帮助学生建立嵌入式系统开发和设计的基本理念,能够设计和实现常见的外设驱动程序,能够进行操作系统的配置和移植,能够自行对实验板进行一定程度的扩展;设计实验能够帮助学生提高嵌入式系统的设计开发能力,使学生能根据需要设计出实现一定功能的扩展模块,从而使实验板扩展成实现具体功能的工业产品。基础实验包括ADS集成环境实验、键盘实验(GPIO输入)、LED实验(GPIO输出)、定时器实验、外部中断实验、UART串口通信实验、I2C接口实验、液晶显示实验;扩展实验包括建立交叉编译环境实验、操作系统编译实验、操作系统移植实验、以太网通信实验、TFTP实验、WEB访问实验;设计实验包括TCP/IP协议栈实验、Web服务器实验。学生通过完成基础实验、扩展实验和设计实验来达到教学大纲的要求,并可以在此基础上进行更深入的创新性开发实验,可以满足一般高校嵌入式技术实验课程教学的需要。 论文介绍了嵌入式交叉编译环境的建立以及实验开发板设计完成后进行的调试。实验开发板移植的嵌入式操作系统为uClinux,采用的Bootloader为U-boot。论文还简单介绍了实验系统的扩展方案和二次开发方案,并对嵌入式新技术的发展做了粗浅的探讨。 论文所做的工作以科学发展观为指导,是对普通高校ARM嵌入式技术实验课程设计的一次有益探索。

    标签: ARM 嵌入式 教学实验系统

    上传时间: 2013-04-24

    上传用户:jjq719719

  • 74164 TTL八位串行入、并行输出移位寄存器

    These 8-bit shift registers feature gated serial inputs andan asynchronous clear. A LOW logic le

    标签: 74164 TTL 串行 并行

    上传时间: 2013-06-12

    上传用户:qq521

  • 单电源低功耗A/D转换器AD7714及其应用

    介绍单电源、低功耗、高精度 A/D转换器 AD7714的特点、内部寄存器结构和外部接口;详细阐述 AD7714与单片机 AT89C51的接口技术。

    标签: 7714 AD 单电源 低功耗

    上传时间: 2013-06-30

    上传用户:CSUSheep

  • 基于以太网接口的ARMJTAG仿真器设计

    在嵌入式系统的开发过程中,仿真器是一个必不可少的开发工具。特别是对于初级嵌入式系统开发工程师,借助一个功能强大的仿真器进行开发工作,可以达到事半功倍的效果。一个嵌入式仿真、调试系统支持单步执行、设置断点、观察变量内容及寄存器内容等功能。开发人员可以通过各类调试功能观察变量和寄存器的变化,从而可以很清楚的了解整个程序运行的状况,及时的调整和修改程序,并不需要反复的向芯片烧写程序,就可以完成对于程序的调试工作。 @@ 本文在分析了目前市场上常用仿真器的设计原理的基础上,提出了以三星公司的S3C44BO ARM7处理器为主CPU,通过以太网接口进行数据传输的ARMJTAT仿真器的设计方案。利用这种仿真器进行程序调试,不仅可以大幅度的提高下载速度,还可以实现仿真器资源的共享,而且调试时程序是在目标板上运行,仿真更接近于目标硬件。 @@ 文中首先对于传统仿真器的设计原理、作用、存在的问题进行了研究,然后提出了基于S3C44BO的以太网接口的ARM-JTAG仿真器的设计。该仿真器的设计主要分为以下几步:第一,提出总体设计方案,包括硬件的设计及软件的设计。第二,详细介绍该仿真器的硬件结构设计和程序开发过程,其中特别对以太网接口的设计进行了研究。第三,总结了该仿真器的功能、特点。 @@关键词:仿真器;S3C44BO;以太网接口;JTAG;LwIP

    标签: ARMJTAG 以太网接口 仿真器

    上传时间: 2013-06-16

    上传用户:253189838

  • 基于ARM处理器S3C44B0的自动指纹识别系统研究

    指纹识别是在指纹图像上找到指纹的特征,通过计算机模糊比较的方法,把两个指纹的特征模板进行比较,计算出它们的相似程度,最终得到两个指纹的匹配结果。本文对现已存在的多种指纹识别算法进行编程比较,并对细化算法提出改进。同时采用基于ARM7TDMI内核的32位处理器S3C44B0作为主控制器,半导体电容传感器FPS200作为指纹数据采集设备,构建了自动指纹识别系统。论文完成主要工作如下: 1、指纹采集模块的设计:根据FPS200的相关寄存器资源和管脚特性,完成指纹传感器FPS200的电路设计;研究FPS200主要寄存器的功能和图像采集方式,给出FPS200在三种工作方式下的工作流程,并且对三种工作模式进行分析。 2、指纹识别算法研究:通过对现已存在的多种图像预处理算法进行编程实现和对比研究发现,细化后的图像多存在短线、断线、毛刺等干扰以及细化不彻底的现象,为此提出了新的修复算法:分析目标点周围纹线的走向趋势,选择去除或者保留周围的相连点,较好地解决了细化不彻底的问题;再对细化后的图像采用方形模板进行纹线跟踪,去除伪特征点,克服了逐步递进的纹线跟踪算法过于复杂、不易实现等问题。 3、采用Sansung公司基于ARM7TDMI内核的32位RISC处理器S3C44B0,构建了自动指纹识别系统。该系统主要包括电源管理部分、指纹图像采集模块、存储器模块、JTAG调试接口以及与外设连接的串行接口。硬件部分主要完成指纹采集模块接口的设计与开发,软件部分主要完成指纹图像采集程序、指纹识别算法程序和串口通信程序的开发,此外还通过串口实现指纹数据上传到上位机,在VB环境下实现了简易的人机交互软件,提供指纹图像的直观显示,用于对指纹识别程序进行测试,并对测试结果进行了分析。

    标签: S3C44B0 ARM 处理器 自动

    上传时间: 2013-05-22

    上传用户:Andy123456