在Pro/ENGINEER中，当创建或处理非实体曲面时，使用的是面组。面组代表相连非实体曲面的“拼接体”。面组可能由单个曲面或一个曲面集合组成。 面组包含了描述所有组成面组的曲面的几何信息，和面组曲面的“缝合”（连接或交截）方法信息。一个零件包含多种面组。通过使用“曲面特征”创建或处理面组。 使用曲面功能 从“特征类”菜单中选择“曲面”，显示“面组曲面”还是“曲面选项”菜单，取决于模型中是曲面还是曲线。如果曲面特征或基准曲线存在于模型中，系统将显示“曲面选项”菜单，它可用于创建新曲面。 也可以通过“插入”菜单来使用多数曲面命令。 命名面组可以使用命令序列“设置”/“名称”/“其它”，为整个面组或单独的曲面分配名称。然后可以使用“获得选取”中的“按菜单选取”选项，按名称选择已命名的面组或曲面。
上传时间： 2013-11-25
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通用阵列逻辑GAL实现基本门电路的设计 一、实验目的 1.了解GAL22V10的结构及其应用； 2.掌握GAL器件的设计原则和一般格式； 3.学会使用VHDL语言进行可编程逻辑器件的逻辑设计； 4.掌握通用阵列逻辑GAL的编程、下载、验证功能的全部过程。 二、实验原理 1. 通用阵列逻辑GAL22V10 通用阵列逻辑GAL是由可编程的与阵列、固定（不可编程）的或阵列和输出逻辑宏单元（OLMC）三部分构成。GAL芯片必须借助GAL的开发软件和硬件，对其编程写入后，才能使GAL芯片具有预期的逻辑功能。GAL22V10有10个I/O口、12个输入口、10个寄存器单元，最高频率为超过100MHz。 ispGAL22V10器件就是把流行的GAL22V10与ISP技术结合起来，在功能和结构上与GAL22V10完全相同，并沿用了GAL22V10器件的标准28脚PLCC封装。ispGAl22V10的传输时延低于7.5ns，系统速度高达100MHz以上，因而非常适用于高速图形处理和高速总线管理。由于它每个输出单元平均能够容纳12个乘积项，最多的单元可达16个乘积项，因而更为适用大型状态机、状态控制及数据处理、通讯工程、测量仪器等领域。ispGAL22V10的功能框图及引脚图分别见图1-1和1-2所示。 另外，采用ispGAL22V10来实现诸如地址译码器之类的基本逻辑功能是非常容易的。为实现在系统编程，每片ispGAL22V10需要有四个在系统编程引脚，它们是串行数据输入(SDI)，方式选择(MODE)、串行输出(SDO)和串行时钟(SCLK)。这四个ISP控制信号巧妙地利用28脚PLCC封装GAL22V10的四个空脚，从而使得两种器件的引脚相互兼容。在系统编程电源为+5V，无需外接编程高压。每片ispGAL22V10可以保证一万次在系统编程。 ispGAL22V10的内部结构图如图1-3所示。 2.编译、下载源文件 用VHDL语言编写的源程序，是不能直接对芯片编程下载的，必须经过计算机软件对其进行编译，综合等最终形成PLD器件的熔断丝文件(通常叫做JEDEC文件，简称为JED文件)。通过相应的软件及编程电缆再将JED数据文件写入到GAL芯片，这样GAL芯片就具有用户所需要的逻辑功能。 3.工具软件ispLEVER简介 ispLEVER 是Lattice 公司新推出的一套EDA软件。设计输入可采用原理图、硬件描述语言、混合输入三种方式。能对所设计的数字电子系统进行功能仿真和时序仿真。编译器是此软件的核心，能进行逻辑优化，将逻辑映射到器件中去，自动完成布局与布线并生成编程所需要的熔丝图文件。软件中的Constraints Editor工具允许经由一个图形用户接口选择I/O设置和引脚分配。软件包含Synolicity公司的“Synplify”综合工具和Lattice的ispVM器件编程工具，ispLEVER软件提供给开发者一个简单而有力的工具。
上传时间： 2013-11-17
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和利时资料
上传时间： 2013-11-25
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继电器延时输出模块
上传时间： 2014-01-03
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NE555延时断开电路
上传时间： 2013-11-24
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PLC在安装和维护时应注意的问题
标签： PLC
上传时间： 2013-11-08
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提出了一个考虑ＦＰ 效应的半导体材料参数测量方案。利用该方案可以在时域波形中，截取多个反射回峰，以提高材料参数提取的精确度。另外，考虑到多重反射对样品厚度的准确性要求较高，提出了一种有效的厚度优化方法。以ＧａＡｓ 为待测样品，利用上述方法精确提取了其折射率与消光系数谱.
上传时间： 2013-12-16
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MPI_DP接口的分配
上传时间： 2013-10-28
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安装时修改执行文件记录硬件配置参数从而做唯一安装标志防止非法复制
上传时间： 2014-10-26
上传用户：redmoons
机器启动时选择从哪个分区启动
上传时间： 2013-12-26
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