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电话计费器程序/*信号定义： clk：时钟信号，本例中其频率值为1Hz； decide：电话局反馈回来的信号，代表话务种类，“01”表示市话，“10”表示长话，“11”表示特话； dis...

📅 2014-01-15

模块使用外部滤波器回路来抑制信号抖动和电磁干扰。滤波器回路由PLL接在滤波器输入引脚PLLF和PLLF2之间的电阻Rl和电容Cl、C2组成。电容 Cl、C2必须为无极性电容。在不同的振荡器频率下，R1...

📅 2014-01-07

术是继直接频率合成和间接频率合成之后，随有4～20倍可编程时钟乘法电路，系统最高时钟可达300 MHz,输出频率可达120 MHz，频率转化速度小于1μs。内部有12位D/A转化器、48位可编程频率寄...

📅 2015-08-04

用verilog设计密勒解码器一、题目：设计一个密勒解码器电路二、输入信号： 1． DIN：输入数据 2． CLK：频率为2MHz的方波，占空比为50％ 3． RESET：复位信号...

📅 2013-12-02

2001年全国大学生电子设计竞赛“索尼杯”得主——调频收音机本调频收音机主要由索尼公司的FM/AM收音机芯片CXA1019、ROHM公司的PLL频率合成器BU2614(本刊网站上提供了该芯片的资料...

📅 2013-12-16

摘要文章介绍了直接数字频率合成器(DDS)的组成及工作原理，描述了DDS芯片 AD9852的功能特性，同时给出了AD9852在本地同步时钟中的应用。关键词 DDS AD985...

📅 2015-11-30

摘要：AD9852是美国AD公司生产的新型直接数字频率合成器(DDS)，是一种使用方便灵活、功能较强的芯片。这种商用集成芯片可用于本振合成回路，高精度时钟发生器等。介绍了AD9852的工作原理、功能...

📅 2015-11-30

摘要：AD9852是美国ANALOGDEVICES公司生产的新型直接数字频率合成器(DDS)，具有频率转换速度快(小于lt~s)、频谱纯度高、工作温度范围宽(一25℃～+85℃)、集成度高等特点，是一...

📅 2015-11-30

本程序实现了一个数字频率计。它由一个测频控制信号发生器TESTCTL，8个有时钟的十进制计数器CNT10，一个32位锁存器REG32B组成。...

📅 2013-12-16

分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太...

📅 2016-06-14

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