通过一个数字信号功率谱分析程序设计的实例，详细地介绍了Visual c++和Matlab通过 engine引擎接口进行混合编程的技术，在信号处理的软件开发中采用这种方法可以提高软件开发 的效率和可靠性。
上传时间： 2017-06-21
上传用户：天诚24
ADS8364是美国德州仪器公司(TI)的一款六通道、16位并行输出、同步采样的模数转换器。该芯片提供了一个灵活的高速并行接口，可以直接与数字信号处理器TMS320F2812相连。本文主要介绍了这个接口的软、硬件设计，着重论述了这两款芯片是如何配置启动和工作的。本设计广泛应用于电机控制、多轴定位系统、三相功率转换、多通道数据采集等场合。
上传时间： 2017-08-03
上传用户：我们的船长
PGP SDK 包括大范围的标准加密、数字签名和编解码技术，以及各种网络安全协议执行程序。PGP SDK为开发人员提供同其他PGP产品核心相同的核加密功能。 PGP SDK技术说明：PGP SDK是我们的加密和密钥管理库的C接口，支持以下平台： · Windows 98, Millennium (ME), NT, 2000, and XP · Mac OS X · Linux x86 with 2.0.x kernel or later · Sun Solaris SPARC 2.5.1, 2.6, 2.7, or 2.8
上传时间： 2014-12-08
上传用户：四只眼
ITU656 中文版国际电信联盟无线电通信部门656-3 号建议书： 工作在ITU-R BT.601 建议（部分A）的 4:2:2 级别上的525 行和625 行电视系统 中的数字分量视频信号的接口
上传时间： 2017-08-22
上传用户：aa54
数字处理及显示技术专辑 106册 913M工业接口与通讯课程概述 48页 4.2M.pdf
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上传时间： 2014-05-05
上传用户：时代将军
数字处理及显示技术专辑 106册 913M计算机通信与rs-232接口实用指南 549页 11.2M.pdf
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上传时间： 2014-05-05
上传用户：时代将军
介绍了 FPGA 的相关基础知识，然后分别通过 7 个在实际工程应用中的案例详细 介绍了通过 FPGA 实现 I 2C 协议要求的接口、 UART 控制器、USB 接口控制器、数字视频信号处 理器、VGA/LCD 显示控制器、CAN 总线控制器、以太网控制器的方法。
标签： FPGA
上传时间： 2015-05-06
上传用户：lipeng
数字对讲机DMR技术标准的空中接口协议，适合对讲机研发和测试的技术人员参考。
上传时间： 2017-05-26
上传用户：huliyou888
描述了数字移动无线电系统（DMR），该系统采用双时隙时分多址技术(TDMA)， 射频载波带宽为12.5kHz。描述了数字移动无线电系统空中接口的物理层和数据链路层。
上传时间： 2017-05-26
上传用户：huliyou888
lm75A温度数字转换器 FPGA读写实验Verilog逻辑源码Quartus工程文件+文档资料,FPGA为CYCLONE4系列中的EP4CE6E22C8. 完整的工程文件，可以做为你的学习设计参考。LM75A 是一个使用了内置带隙温度传感器和模数转换技术的温度数字转换器。它也是一个温度检测器，可提供一个过热检测输出。LM75A 包含许多数据寄存器：配置寄存器用来存储器件的某些配置，如器件的工作模式、OS 工作模式、OS 极性和OS 故障队列等（在功能描述一节中有详细描述）；温度寄存器（Temp），用来存储读取的数字温度；设定点寄存器（Tos & Thyst），用来存储可编程的过热关断和滞后限制，器件通过2 线的串行I2C 总线接口与控制器通信。LM75A 还包含一个开漏输出（OS），当温度超过编程限制的值时该输出有效。LM75A 有3 个可选的逻辑地址管脚，使得同一总线上可同时连接8个器件而不发生地址冲突。LM75A 可配置成不同的工作条件。它可设置成在正常工作模式下周期性地对环境温度进行监控或进入关断模式来将器件功耗降至最低。OS 输出有2 种可选的工作模式：OS 比较器模式和OS 中断模式。OS 输出可选择高电平或低电平有效。故障队列和设定点限制可编程，为了激活OS 输出，故障队列定义了许多连续的故障。温度寄存器通常存放着一个11 位的二进制数的补码，用来实现0.125℃的精度。这个高精度在需要精确地测量温度偏移或超出限制范围的应用中非常有用。正常工作模式下，当器件上电时，OS 工作在比较器模式，温度阈值为80℃，滞后75℃，这时，LM75A就可用作一个具有以上预定义温度设定点的独立的温度控制器。module LM75_SEG_LED ( //input input sys_clk ,input sys_rst_n ,inout sda_port ,//output output wire seg_c1 ,output wire seg_c2 ,output wire seg_c3 ,output wire seg_c4 ,output reg seg_a ,output reg seg_b ,output reg seg_c ,output reg seg_e ,output reg seg_d ,output reg seg_f ,output reg seg_g ,output reg seg_h , output reg clk_sclk );//parameter define parameter WIDTH = 8;parameter SIZE = 8;//reg define reg [WIDTH-1:0] counter ;reg [9:0] counter_div ;reg clk_50k ;reg clk_200k ;reg sda ;reg enable ;
上传时间： 2021-10-27
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