DFT(Discrete Fourier Transformation)是数字信号分析与处理如图形、语音及图像等领域的重要变换工具,直接计算DFT的计算量与变换区间长度N的平方成正比.当N较大时,因计算量太大,直接用DFT算法进行谱分析和喜好的实时处理是不切实际的.快速傅里叶变换(Fast Fourier Transformation,简称FFT)使DFT运算效率提高1~2个数量级.本文的目的就是研究如何应用FPGA这种大规模可编程逻辑器件实现FFT的算法.本设计主要采用先进的基-4DIT算法研制一个具有实用价值的FFT实时硬件处理器.在FFT实时硬件处理器的设计实现过程中,利用递归结构以及成组浮点制运算方式,解决了蝶形计算、数据传输和存储操作协调一致问题.合理地解决了位增长问题.同时,采用并行高密度乘法器和流水线(pipeline)工作方式,并将双端口RAM、只读ROM全部内置在FPGA芯片内部,使整个系统的数据交换和处理速度得以很大提高,实际合理地解决了资源和速度之间相互制约的问题.本设计采用Verilog HDL硬件描述语言进行设计,由于在设计中采用Xilinx公司提供的称为Core的IP功能块极大地提高了设计效率.
上传时间： 2013-06-20
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航天测控通信网是航天工程的重要组成部分。迄今为止，我国已建成“C频段测控网”，及正在建设的“S频段测控网”和“TDRSS测控网”。测距单元是测控系统基带设备中的重要功能单元，为航天飞行器提供定位元素。目前，在航天测距系统中侧音测距技术具有最高的测距精度。本文以中国电子科技集团第十研究所某项目为背景，对侧音测距系统中的关键技术进行了详细的研究，提出了一些改进测距精度的方法，最后用FPGA实现了侧音测距功能单元。 本论文主要完成以下工作： 1)完成了直接数字频率合成的杂散分析。采用严格的信号分析方法，运用离散傅立叶变换(DFT)和傅立叶变换(FT)，推导了理想状态和相位截短条件下的DDS输出频谱的数学表达式，并利用systemview仿真软件建立了DDS相位截短模型，通过仿真验证了分析结论的正确性。 2)改进了TT&C系统中经典的FFT频率引导算法，增加了频谱对称性分析，在实现频率引导的同时完成了防载波频率错锁的功能。 3)首次采用基于正交双通道相关原理的数字相关相位估计法来实现次侧音匹配和解模糊，降低了设备复杂度，提高了测距精度。针对低信噪比的情况，提出了基于平滑滤波的数据处理方法，提高了相位测量精度。对测距信道中加限幅器导致的测距信号信噪比恶化程度做了深入的理论分析。最后，分析了测距误差，并对其中一些引起测距误差的因素提出了改善方法。 通过本论文的工作，成功的完成了TT&C侧音测距终端的研制，系统现已通过测试，达到系统任务书的各项指标要求。
上传时间： 2013-04-24
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随着嵌入式控制在工业领域的不断渗入，进入21世纪之后，基于ARM体系Linux操作系统的嵌入式一体化工业控制系统成为了工业控制的主要发展方向，ARM芯片不仅体积小，功耗低，而且功能强；Linux由于其开源，稳定以及成本低的优点，在嵌入式系统中得到了广泛的应用。 本文研究的主要内容是基于Linux操作系统ARM体系的嵌入式工控一体机设计与实现。该嵌入式工控一体机是基于Motorola公司研发的ARM9嵌入式系统和Linux操作系统的设备，整个系统体积小，结构精简，并有很高的执行效率。它根据特定的工业控制对象定制特定的模型与控制算法。另外，该设备自身还具备各种数字PID控制算法，实现PID闭环控制。可以应用于工业控制领域中的各类被控设备，以及为高校自动化控制实验和工业应用研究提供解决方案。它的软件编程由Qt集成开发环境实现，Qt是基于C++的针对构造图形用户界面（程序）所使用的GUI工具包，它速度块，易于使用，并具有很好的可移植性。 本文首先对嵌入式系统进行选型，然后提出了系统的软硬件整体架构和系统的启动流程。接着介绍了系统开发环境的搭建，包括启动加载器的设计和实现，Linux内核的移植，设备驱动程序的编写以及图形用户界面的实现。最后，详细介绍了一个具有创新性的案例作为该嵌入式Linux工控一体机作为通讯和控制终端的典型应用。 该嵌入式Linux工控一体机具有极好的实用性和应用前景，并且其设计和实现过程对于其它嵌入式平台也具有很好的参考价值。
上传时间： 2013-07-27
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随着计算机和网络技术应用的扩展，电能的远程自动监测、计算与收费的方案逐步被采用，能源计量仪表的数据自动抄收及远传系统的建设成为智能化住宅的基本配置之一。 本文针对校园的学生宿舍的电表收费进行了探讨，到目前为止、按照收费方式电子式电能表可以分为：接触式和非接触式的IC卡预付费电表、复费率电表、和分时预付费的复费率电表。针对这几种电表的抄表方式也各不相同，预付费电表主要是应用IC卡充值的方法付费、而复费率的电表主要是采用人工抄表和布线抄表的方法、而分时预付费复费率的电表主要是使用IC卡充值之后，利用实时时钟在用电峰谷时对存储在电表能的金额进行扣除。文中设计的自动抄表系统可以实现对上述三种电表的抄录工作，尤其是针对校园学生宿舍等应用场所具用重要的意义。 文章提出了整体的方案设计，三级网络分别应用了无线传输和网络传输的方案，解决了远程电能计量计费系统的由集中器和采集器(采集终端)以及通信信道与抄表软件组成的部分即：集中器到抄表中心的上行信道、集中器至采集器(采集终端)或水电气表间的下行信道。在整体设计思路介绍之后，文章花主要篇幅分章节介绍了复费率电能计量仪表、基于arm和uclinux的无线收发集中控制器的软硬件，上位机的主控界面的设计。其中电能表的开发分块介绍了软硬件的各个部分，集中控制器由于嵌入了实时操作系统uclinux，着重讲述了基于操作系统的应用程序的开发，主站界面介绍了简单的测试程序。然后通过测试的结果说明了课题设计的系统实现了数据的基本采集和控制的情况，最后本文总结了研究的成果，并提出了改进的方向。
上传时间： 2013-07-04
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常用的实时数字信号处理的器件有可编程的数字信号处理(DSP)芯片(如AD系列、TI系列)、专用集成电路(ASIC)、现场可编程门阵列(FPGA)等。在工程实践中,往往要求对信号处理要有高速性、实时性和灵活性,而已有的一些软件和硬件实现方式则难以同时达到这几方面的要求。随着可编程逻辑器件和EDA技术的发展,使用FPGA来实现数字信号处理,既具有实时性,又兼顾了一定的灵活性。FPGA具有的灵活的可编程逻辑可以方便的实现高速数字信号处理,突破了并行处理、流水级数的限制,有效地利用了片上资源,加上反复的可编程能力,越来越受到国内外从事数字信号处理的研究者所青睐。 FIR数字滤波器以其良好的线性特性被广泛使用,属于数字信号处理的基本模块之一。本论文对基于FPGA的FIR数字滤波器实现进行了研究,所做的主要工作如下： 1.介绍了FIR数字滤波器的基本理论和FPGA的基本概况,以及FPGA设计流程、设计指导原则和常用的设计指导思想与技巧。 2.以FIR数字滤波器的基本理论为依据,使用分布式算法为滤波器的硬件实现算法,并对其进行了详细的讨论。针对分布式算法中查找表规模过大的缺点,采用优化分布式算法的多块查找表方式使得硬件规模极大的减小。 3.设计出一个192阶的FIR滤波器实例。其系统要求为：定点16位输入、定点12位系数、定点16位输出,采样率为75MHz。设计用Quartus II软件进行仿真,并将其仿真结果与Matlab仿真结果进行对比分析。 仿真结果表明,本论文设计的滤波器硬件规模较小,采样率达到了75MHz。同时只要将查找表进行相应的改动,就能分别实现低通、高通、带通FIR滤波器,体现了设计的灵活性。
上传时间： 2013-06-06
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数字图像的压缩是解决图像数据量大、存储和传输困难的基本措施。图像压缩的方法很多，一般可分为有损压缩和无损压缩两大类。有损压缩允许一定程度的信息丢失，在满足实际应用的条件下能够取得较高的压缩比；无损压缩不允许信息丢失，但是压缩比难以提高。在医学图像、遥感图像等应用领域，对于图像的压缩比和失真度都有着较高要求，因此需要采用近无损压缩的方法。近无损压缩是有损压缩和无损压缩的一个折衷，允许一定的失真，能够获得高保真还原图像的同时，得到比无损压缩更高的压缩比。 JPEG-LS是连续色调静止图像无损和近无损压缩的国际标准，算法复杂度低，压缩性能优越，但是JPEG-LS对不同图像压缩时压缩比不可控制。本文在研究JPEG-LS近无损图像压缩算法的基础上，针对具体应用背景，提出了一种基于块的近无损压缩方法。进一步利用图像局部纹理特性分析，对不同特性的区域容忍不同的信息丢失程度，实现了对图像压缩的码率控制。针对某工程应用中的具体要求，我们以FPGA为平台，采用Verilog HDL语言对改进算法进行了硬件实现。 实验结果证明，这种基于块的具有码率控制的近无损图像压缩算法，在实现较为精确的码率控制的同时，能够获得较高的还原图像质量，而且硬件实现复杂度低，能够满足对图像的实时压缩要求。
上传时间： 2013-06-18
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H.264/AVC是ITU-T和ISO联合推出的新标准，采用了近几年视频编码方面的先进技术，以较高编码效率和网络友好性成为新一代国际视频编码标准。 本文以实现D1格式的H.264/AVC实时编码器为目标，作者负责系统架构设计，软硬件划分以及部分模块的硬件算法设计与实现。通过对H.264/AVC编码器中主要模块的算法复杂度的评估，算法特点的分析，同时考虑到编码器系统的可伸缩性，可扩展性，本文采用了DSP+FPGA的系统架构。DSP充当核心处理器，而FPGA作为协处理器，针对编码器中最复杂耗时的模块一运动估计模块，设计相应的硬件加速引擎，以提供编码器所需要的实时性能。 H.264/AVC仍基于以前视频编码标准的运动补偿混合编码方案，其中一个主要的不同在于帧间预测采用了可变块尺寸的运动估计，同时运动向量精度提高到1/4像素。更小和更多形状的块分割模式的采用，以及更加精确的亚像素位置的预测，可以改善运动补偿精度，提高图像质量和编码效率，但同时也大大增加了编码器的复杂度，因此需要设计专门的硬件加速引擎。 本文给出了1/4像素精度的运动估计基于FPGA的硬件算法设计与实现，包括整像素搜索，像素插值，亚像素(1/2，1/4)搜索以及多模式选择(支持全部七种块分割模式)。设计中，将多处理器技术和流水线技术相结合，提供高性能的并行计算能力，同时，采用合理的存储器组织结构以提供高数据吞吐量，满足运算的带宽要求，并使编码器具有较好的可伸缩性。最后，在Modelsim环境下建立测试平台，完成了对整个设计的RTL级的仿真验证，并针对Altera公司的FPGA芯片stratixⅡ系列的EP2S60-4器件进行优化，从而使工作频率最终达到134MHz，分析数据表明该模块能够满足编码器的实时性要求。
上传时间： 2013-07-24
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随着社会的进步及移动用户的迅猛增长，第三代移动通信越来越受到各界的重视。多用户检测技术是第三代移动通信中重要的技术之一；常规CDMA接收机采用匹配滤波器的结构，但是这种结构的接收机并没有考虑到信道中多址干扰的存在，使彼此间影响减少来提高系统容量；而功控的方法也没有从接收信号中真正去除多址干扰，只能缓解这种矛盾，不能从根本上解决问题。要想真正消除干扰，大幅度提高系统容量，必须通过多址对消和多用户检测技术。 本文首先介绍了CDMA的基本原理和多用户检测的基本原理。然后重点介绍和分析各种多用户检测的原理，然后依据多用户检测的四个技术指标对各种多用户检测的方法进行比较，从中选择实现简单，性能优越的解相关检测器来作为实现的标的算法。 然后，本文重点研究分析解相关检测器的原理，给出了实现解相关检测器的系统设计的流程，其中包括硬件电路的搭建和软件实现的方法。硬件电路是基于DSP(TI公司的TMS320C5402)和FPGA(Altera公司的EP1K10Q208-3)来完成。软件部分主要采用C语言来完成。 本文系统研究了多用户检测技术，并实现了解相关算法，在理论研究和实际应用方面都有一定的价值。
上传时间： 2013-07-29
上传用户：anpa
本文对基于FPGA的CCSDS图像压缩和AES加密算法的实现进行了研究。主要完成的工作有： (1)深入研究CCSDS图像压缩算法，并根据其编码方案，设计并实现了相应的编解码器。从算法性能和硬件实现复杂度两个方面，将该算法与具有类似算法结构的JPEG2000和SPIHT图像压缩算法作比较分析； (2)利用硬件描述语言VerilogHDL实现CCSDS图像压缩算法和AES加密算法； (3)优化算法复杂度较大的功能模块，如小波变换模块等。使用双端口内存模块增加数据读写速度，利用DSP块处理核心运算单元，从而很大程度上提高了模块的运行速度，并降低了芯片的使用面积； (4)设计并实现系统的模块级流水线，在几乎不增加占用芯片面积的情况下，提高了系统的数据吞吐量； (5)在QuartusⅡ和ModelSim仿真环境下对该系统进行模块级和系统级的功能仿真、时序仿真和验证。在硬件系统测试阶段，设计并实现FPGA与PC机的串口通信模块，提高了系统验证的工作效率。
上传时间： 2013-05-19
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本文重点研究的是补偿编码键控(CCK)的调制与解调算法原理，以及基于FPGA进行的系统设计实现。作为IEEE802.11b标准中关键的调制技术，CCK码具有良好的相关特性，能够在高速率传输数据的同时有效的克服多径效应。本文首先对WLAN的结构和特点进行了简单介绍，对其中的IEEE802.11b标准进行了研究，并着重分析了其物理层基带部分的结构和规范。然后系统的介绍了CCK码的特点，重点对11Mb/s模式下基于“基本CCK码字集”的CCK调制原理和基于快速沃尔什变换(FWT)块的CCK解调原理进行了分析讨论。接下来通过在Matlab中对调制和解调方案的仿真，得到了正确的理论数据，并验证了系统设计的可行性。最后在Xilinx公司的ISE6.2开发环境下，使用硬件描述语言Verilog HDL对CCK调制和解调系统在FPGA中进行了设计，然后将整个系统在ModelSim中进行了功能仿真。理论分析和仿真结果的比较表明系统设计是正确的，而且系统性能良好。 本文所设计的基于FPGA的CCK调制和解调系统具有集成度高、稳定性强和能够在线软件更新等特点。研究成果可以给将来设计更高性能、更高集成度的基带WLAN芯片提供基础。
上传时间： 2013-06-02
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