STM8S105xx_中文资料：这本数据手册描述了STM8S105xx基础型系列单片机的特点、引脚分配、电气特性、机械特性和订购信息。 如果需要关于STM8S单片机存储器、寄存器和外设等的详细信息，请参考STM8S系列单片机参考手册(RM0016) 。 如果需要关于内部Flash存储器的编程、擦除和保护的信息，请参考STM8S闪存编程手册(PM0051) 。 如果需要关于调试和SWIM(single wire interface module单线接口模块)，请参考STM8SWIM 通信协议和调试模块用户手册(UM0470) 。 如果需要关于STM8 内核的信息，请参考STM8 CPU编程手册(PM0044) 。
上传时间： 2013-11-03
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第一章 虚拟仪器及labview入门 １．１ 虚拟仪器概述 １．２ labview是什么？ １．３ labview的运行机制 １．３．１ labview应用程序的构成 １．３．２ labview的操作模板 １．４ labview的初步操作 １．４．１ 创建VI和调用子VI １．４．２ 程序调试技术 １．４．３ 子VI的建立 １．５ 图表（Chart）入门 第二章 程序结构 ２．１ 循环结构 ２．１．１ While 循环 ２．１．２ 移位寄存器 ２．１．３ For循环 ２．２ 分支结构：Case ２．３ 顺序结构和公式节点 ２．３．１ 顺序结构 ２．３．２ 公式节点 第三章 数据类型：数组、簇和波形（Waveform） ３．１ 数组和簇 ３．２ 数组的创建及自动索引 ３．２．１ 创建数组 ３．２．２ 数组控制对象、常数对象和显示对象 ３．２．３ 自动索引 ３．３ 数组功能函数 ３．４ 什么是多态化（Polymorphism）? ３．５ 簇 ３．５．１ 创建簇控制和显示 ３．５．２ 使用簇与子VI传递数据 ３．５．３ 用名称捆绑与分解簇 ３．５．４ 数组和簇的互换 ３．６ 波形（Waveform）类型 第四章 图形显示 ４．１ 概述 ４．２ Graph控件 ４．３ Chart的独有控件 ４．４ XY图形控件（XY Graph） ４．５ 强度图形控件（Intensity Graph） ４．６ 数字波形图控件（Digital Waveform Graph） ４．７ 3D图形显示控件（3D Graph） 第五章 字符串和文件I/ ５．１ 字符串 ５．２ 文件的输入/输出（I/O） ５．２．１ 文件 I/O 功能函数 ５．２．２ 将数据写入电子表格文 ５．３ 数据记录文件（datalog file） 第六章 数据采集 ６．１ 概述 ６．１．１ 采样定理与抗混叠滤波器 ６．１．２ 数据采集系统的构成 ６．１．３ 模入信号类型与连接方式 ６．１．４ 信号调理 ６．１．５ 数据采集问题的复杂程度评估 ６．２ 缓冲与触发 ６．２．１ 缓冲（Buffers） ６．２．２ 触发（Triggering） ６．３ 模拟I/O（Analog I/O） ６．３．１ 基本概念 ６．３．２ 简单 Analog I/O ６．３．３ 中级Analog I/O ６．４ 数字I/O（Digital I/O） ６．５ 采样注意事项 ６．５．１ 采样频率的选择 ６．５．２ ６．５．３ 多任务环境 ６．６ 附：PCI-MIO-16E-4数据采集卡简介 第七章 信号分析与处理 ７．１ 概述 ７．２ 信号的产生 ７．３ 标准频率 ７．４ 数字信号处理 ７．４．１ FFT变换 ７．４．２ 窗函数 ７．４．３ 频谱分析 ７．４．４ 数字滤波 ７．４．５ 曲线拟合 第八章 labview程序设计技巧 ８．１ 局部变量和全局变量 ８．２ 属性节点 ８．３ VI选项设置 第九章 测量专题 ９．１ 概述 ９．１．１ 模入信号类型与连接方式 ９．１．２ 信号调理 ９．２ 电压测量 ９．３ 频率测量 ９．４ 相位测量 ９．５ 功率测量 ９．６ 阻抗测量 ９．７ 示波器 ９．８ 波形记录与回放 ９．９ 元件伏安特性的自动测试 ９．１０ 扫频仪 ９．１１ 函数发生器 ９．１２ 实验数据处理 ９．１３ 频域分析 ９．１４ 时域分析 第十章 网络与通讯 第十一章 仪器控制
上传时间： 2013-11-06
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常见问题数据采集控制系统的组成？ 1、变送器和执行器 2、信号调理器3、数据采集控制硬件4、计算机软件 选择数据采集卡要从那几个方面进行考虑？ 1、通道的类型及个数2、差分或单端输入3、采样速度4、精度要求 名词解释单端输入方式：各路输入信号共用一个参考电位，即各路输入信号共地，这是最常用的接线方式。使用单端输入方式时，地线比较稳定，抗干扰能力较强。 双端输入方式：各路输入信号各自使用自己的参考电位，即各路输入信号不共地。如果输入信号来自不同的信号源，而这些信号源的参考电位(地线)略有差异，可考虑使用这种接线方式。 单极性信∶号输入信号相对于模拟地电位来讲,只偏向一侧,如输入电压为0～10V。双极性信号∶输入信号相对于模拟地电位来讲,可高可低,如输入电压为-5V～+5V。 A/D转换速率∶表明A/D转换芯片的工作速度。 初始地址∶使用板卡时，需要对卡上的一组寄存器进行操作，这组寄存器占用数个连续的地址，一般将其中最低的地址值定为此卡的初始地址。
上传时间： 2014-01-13
上传用户：sy_jiadeyi
第1 章 体系结构 ARM经典300问与答第1 问:Q:请问在初始化CPU 堆栈的时候一开始在执行mov r0, LR 这句指令时处理器是什么模式A:复位后的模式,即管理模式.第2 问:Q:请教:MOV 中的8 位图立即数,是怎么一回事 0xF0000001 是怎么来的A:是循环右移,就是一个0—255 之间的数左移或右移偶数位的来的,也就是这个数除以4一直除, 直到在0-255 的范围内它是整数就说明是可以的!A:8 位数(0-255)循环左移或循环右移偶数位得到的,F0000001 既是0x1F 循环右移4 位,符合规范,所以是正确的.这样做是因为指令长度的限制,不可能把32 位立即数放在32 位的指令中.移位偶数也是这个原因.可以看一看ARM 体系结构(ADS 自带的英文文档)的相关部分.第3 问:Q:请教:《ARM 微控制器基础与实战》2.2.1 节关于第2 个操作数的描述中有这么一段:#inmed_8r 常数表达式.该常数必须对应8 位位图,即常熟是由一个8 位的常数循环移位偶数位得到.合法常量:0x3FC,0,0xF0000000,200,0xF0000001.非法常量:0x1FE,511,0xFFFF,0x1010,0xF0000010.常数表达式应用举例:......LDR R0,[R1],#-4 ;读取 R1 地址上的存储器单元内容,且 R1 = R1-4针对这一段,我的疑问:1. 即常数是由一个8 位的常数循环移位偶数位得到,这句话如何理解2. 该常数必须对应8 位位图,既然是8 位位图,那么取值为0-255,怎么0x3FC 这种超出255 的数是合法常量呢3. 所举例子中,合法常量和非法常量是怎么区分的 如0x3FC 合法,而0x1FE 却非法0xF0000000,0xF0000001 都合法,而0xF0000010 又变成了非法4. 对于汇编语句 LDR R0,[R1],#-4,是先将R1 的值减4 结果存入R1,然后读取R1 所指单元的 值到R0,还是先读取R1 到R0,然后再将R1 减4 结果存入R1A:提示,任何常数都可用底数*2 的n 次幂 来表示.1. ARM 结构中,只有8bits 用来表示底数,因此底数必须是8 位位图.2. 8 位位图循环之后得到常数,并非只能是8 位.3. 0xF0000010 底数是9 位,不能表示.4. LDR R0, [R1], #-4 是后索引,即先读,再减.可以看一看ARM 体系结构对相关寻址方式的说明.
上传时间： 2013-11-22
上传用户：1109003457
重大消息:完美NRF24L01+的代替面世了,SI24R1,它与NORDIC 的 NRF24L01+是完全兼容的（SPI 的操作时序，寄存器定义，工作状态 图），可以相互通信，支持NRF24L01+的所有通信功能。Si24R 完全 PIN 对PIN 替换NORDIC 的NRF24L01+ ,只要在原来焊NRF24L01P 的 位置上焊上SI24R1，就可以正常通信，SI24R1 还可以与NRF24L01P 相互通信，最大功率做到7DB，灵敏度更高，功耗更低，价格更廉. 为广大NORDIC 的用户节约了不少的生产成本!
上传时间： 2014-01-15
上传用户：ks201314
为解决现Z-Stack定位程序代码量大，结构复杂等问题，提出一种基于TinyOS的CC2430定位方案。在分析TinyOS组件架构基础上，设计实现盲节点、锚节点与汇聚节点间的无线通信以及汇聚节点与PC机的串口通信。在此基础上实现PC对各锚节点RSSI（Received Signal Strength Indicator）寄存器值的正确读取，确定实验室环境下对数-常态无线传播模型的具体参数，并采用质心算法来提高定位精度。实验显示，在由四个锚节点组成的4.8×3.6 m2矩形定位区域中，通过RSSI质心定位算法求得的盲节点坐标为（2.483 1，1.018 5），实际坐标为（2.40，1.20），误差为0.199 6 m，表明较好地实现对盲节点的定位。
上传时间： 2013-10-21
上传用户：whymatalab2
本应用手册阐述了此方案的设计理念，RF1A寄存器，以及WOR功能的时序。同时详细介绍了CC430F613x和CC430F513x等子系列的特殊用例，并将其归档。通过在CC430F613x和CC430F513x子系列上使用WOR的应用实例，本应用手册给出结论。
上传时间： 2013-11-15
上传用户：a471778
基于VHDL的FPGA和Nios II 实例精炼【作者：刘福奇；出版社：北京航空航天大学出版社】（本书优酷视频地址：http://www.youku.com/playlist_show/id_5882081.html） 内容简介：本书分为4个部分：Quartus Ⅱ软件的基本操作、VHDL语法介绍、FPGA设计实例和Nios Ⅱ设计实例；总结了编者几年来的FPGA设计经验，力求给初学者或是想接触这方面知识的读者提供一种快速入门的方法；适合电子相关专业的大学生、FPGA的初学者以及对FPGA有兴趣的电子工程师。初学者可以按照步骤学习。本书中提及到时间计算问题，不光提出有时间戳的方法， 还介绍了一种通过读取定时器的寄存器来计算时间的方法。其实，有人认为，本书最好的部分是：DMA的实现说明（本书从3个方面讲述了DMA的使用）。现在学习Verilog HDL的人或许比较多，但是用VHDL的人可以学习下，这本书还是很不错的。
上传时间： 2014-07-10
上传用户：米米阳123
The Virtex™-4 user access register (USR_ACCESS_VIRTEX4) is a 32-bit register thatprovides direct access to bitstream data by the FPGA fabric. It is useful for loadingPowerPC™ 405 (PPC405) processor caches and/or other data into the FPGA after the FPGAhas been configured, thus achieving partial reconfiguration. The USR_ACCESS_VIRTEX4register is programmed through the bitstream with a command that writes a series of 32-bitwords.
标签： USR_ACCESS PowerPC XAPP 719
上传时间： 2013-12-23
上传用户：yuanwenjiao
FSM 分两大类：米里型和摩尔型。 组成要素有输入(包括复位)，状态(包括当前状态的操作)，状态转移条件，状态的输出条件。 设计FSM 的方法和技巧多种多样，但是总结起来有两大类：第一种，将状态转移和状态的操作和判断等写到一个模块(process、block)中。另一种是将状态转移单独写成一个模块，将状态的操作和判断等写到另一个模块中(在Verilog 代码中，相当于使用两个“always” block)。其中较好的方式是后者。其原因 如下： 首先FSM 和其他设计一样，最好使用同步时序方式设计，好处不再累述。而状态机实现后，状态转移是用寄存器实现的，是同步时序部分。状态的转移条件的判断是通过组合逻辑判断实现的，之所以第二种比第一种编码方式合理，就在于第二种编码将同步时序和组合逻辑分别放到不同的程序块(process，block) 中实现。这样做的好处不仅仅是便于阅读、理解、维护，更重要的是利于综合器优化代码，利于用户添加合适的时序约束条件，利于布局布线器实现设计。显式的 FSM 描述方法可以描述任意的FSM(参考Verilog 第四版)P181 有限状态机的说明。两个 always 模块。其中一个是时序模块，一个为组合逻辑。时序模块设计与书上完全一致，表示状态转移，可分为同步与异步复位。
标签： 状态
上传时间： 2015-01-02
上传用户：aa17807091
