当前,在系统级互连设计中高速串行I/O技术迅速取代传统的并行I/O技术正成为业界趋势。人们已经意识到串行I/O“潮流”是不可避免的,因为在高于1Gbps的速度下,并行I/O方案已经达到了物理极限,不能再提供可靠和经济的信号同步方法。基于串行I/O的设计带来许多传统并行方法所无法提供的优点,包括:更少的器件引脚、更低的电路板空间要求、减少印刷电路板(PCB)层数、PCB布局布线更容易、接头更小、EMI更少,而且抵抗噪声的能力也更好。高速串行I/O技术正被越来越广泛地应用于各种系统设计中,包括PC、消费电子、海量存储、服务器、通信网络、工业计算和控制、测试设备等。迄今业界已经发展出了多种串行系统接口标准,如PCI Express、串行RapidIO、InfiniBand、千兆以太网、10G以太网XAUI、串行ATA等等。 Aurora协议是为私有上层协议或标准上层协议提供透明接口的串行互连协议,它允许任何数据分组通过Aurora协议封装并在芯片间、电路板间甚至机箱间传输。Aurora链路层协议在物理层采用千兆位串行技术,每物理通道的传输波特率可从622Mbps扩展到3.125Gbps。Aurora还可将1至16个物理通道绑定在一起形成一个虚拟链路。16个通道绑定而成的虚拟链路可提供50Gbps的传输波特率和最大40Gbps的全双工数据传输速率。Aurora可优化支持范围广泛的应用,如太位级路由器和交换机、远程接入交换机、HDTV广播系统、分布式服务器和存储子系统等需要极高数据传输速率的应用。 传统的标准背板如VME总线和CompactPCI总线都是采用并行总线方式。然而对带宽需求的不断增加使新兴的高速串行总线背板正在逐渐取代传统的并行总线背板。现在,高速串行背板速率普遍从622Mbps到3.125Gbps,甚至超过10Gbps。AdvancedTCA(先进电信计算架构)正是在这种背景下作为新一代的标准背板平台被提出并得到快速的发展。它由PCI工业计算机制造商协会(PICMG)开发,其主要目的是定义一种开放的通信和计算架构,使它们能被方便而迅速地集成,满足高性能系统业务的要求。ATCA作为标准串行总线结构,支持高速互联、不同背板拓扑、高信号密度、标准机械与电气特性、足够步线长度等特性,满足当前和未来高系统带宽的要求。 采用FPGA设计高速串行接口将为设计带来巨大的灵活性和可扩展能力。Xilinx Virtex-IIPro系列FPGA芯片内置了最多24个RocketIO收发器,提供从622Mbps到3.125Gbps的数据速率并支持所有新兴的高速串行I/O接口标准。结合其强大的逻辑处理能力、丰富的IP核心支持和内置PowerPC处理器,为企业从并行连接向串行连接的过渡提供了一个理想的连接平台。 本文论述了采用Xilinx Virtex-IIPro FPGA设计传输速率为2.5Gbps的高速串行背板接口,该背板接口完全符合PICMG3.0规范。本文对串行高速通道技术的发展背景、现状及应用进行了简要的介绍和分析,详细分析了所涉及到的主要技术包括线路编解码、控制字符、逗点检测、扰码、时钟校正、通道绑定、预加重等。同时对AdvancedTCA规范以及Aurora链路层协议进行了分析, 并在此基础上给出了FPGA的设计方法。最后介绍了基于Virtex-IIPro FPGA的ATCA接口板和MultiBERT设计工具,可在标准ATCA机框内完成单通道速率为2.5Gbps的全网格互联。
上传时间: 2013-05-29
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随着国际互联网络的迅猛发展,网络应用的不断丰富,Intenret已经从最初以学术交流为目的而演变为商业行为,网络安全性需求日益增加,高速网络安全保密成为关注的焦点,在安全得到保障的情况下,为了满足网速无限制的追求,高速网络硬件加密设备也必将成为需求热点。另一方面,IPSec协议被广泛的应用于防火墙和安全网关中,但对IPSec协议的处理会大大增加网关的负载,成为千兆网实现的瓶颈。本文便是针对上述现状,研究基于高性能FPGA实现千兆IPSec协议的设计技术。 目前,国外IPSec协议实现已经芯片化,达到几千兆的速率,但是国内产品多以软件实现,速度难以提高。本文采用的基于FPGA的IPSec技术方案,采用硬件实现隧道模式下的IPSec协议,为IP分组及其上层协议数据提供机密性、数据完整性验证以及数据源验证等安全服务。在以VPN为实施方案的基础上,构建了以KDIPSec为设备原型以IPSec协议为出发点的千兆网络系统环境模型,从硬件体系结构到各个模块的划分以及各个模块实现的功能这几个方面描述了KDIPSec实现技术,最后描述了一些关键模块的FPGA设计和和仿真。所有处理模块均在Xilinx公司的FPGA芯片中实现,处理速率超过1Gb/s。
上传时间: 2013-07-03
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本文提出一种基于PC104嵌入式工业控制计算机与现场可编程门阵列(FPGA)的PCB测试机的硬件控制系统设计方案。方案中设计高效高压控制电路,实现测试电压与测试电流的精确数字控制。选用双高压电子开关形式代替高压模拟电子开关,大幅度提高测试电压。采用多电源方式在低控制电压下实现对高压电子开关的控制。设计高速信号处理电路对测试信号进行处理,从硬件上提高系统测试速度。 本设计中选用Altera公司的现场可编程器(FPGA)EP1K50,利用EDA设计工具Synplify、Modelsim、QuartusⅡ以及Verilog硬件描述语言完成了控制系统的硬件设计及调试,解决了由常规电路难以实现的问题。
上传时间: 2013-06-04
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电力线通信技术利用分布广泛的低压电力线作为通信信道,实现internet高速互连,为用户提供互联网访问、视频点播等服务,形成包括电力在内的“四网合一”,目前正受到人们的关注。利用该技术,可以在居民区内建立宽带接入网,也可以利用遍布家庭各个房间的电源插座组成家庭局域网。但是电力线是传输电能的,因此通过电力线传输数据有许多的问题需要解决。 OFDM(正交频分复用)技术是实现电力线通信的一项热门技术。OFDM采用添加循环前缀的技术,能有效地降低ICI(信道间干扰)和ISI(码间干扰)。同时通过使用正交的子信道,大大提高了频谱资源利用率。FPGA作为可编程逻辑器件,具有设计时间短、投资少、风险小的特点,而且可以反复修改,反复编程,直到完全满足需要,具有其他方式无可比拟的方便性和灵活性,能够加速数字系统的研发速度。本文着重研究了OFDM同步技术在FPGA上的实现。本论文主要是在项目组工作的基础上构造双路信号数据纠正算法流程,提出最佳采样点与载波相位估计算法,完善中各个子模块算法的硬件设计流程。内容安排如下:第一章介绍OFDM(正交频分复用)技术的发展历史、技术原理。第二章介绍了PLD的分类、工艺和结构特点,以及FPGA的开发环境、开发流程和Verilog语言的特点。第三章对OFDM系统的同步模块进行详细的阐述。第四章是OFDM同步算法的在FPGA上的实现,对各个子模块进行仿真,给出了仿真波形图和系统性能分析。最后,第五章总结了全文的工作,对OFDM技术的实现需要进一步完善的方面与后续工作进行了探讨。
上传时间: 2013-04-24
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这本书是专门为电路设计工程师写的。它主要描述了模拟电路原理在高速数字电路设计中 的分析应用。通过列举很多的实例,作者详细分析了一直困扰高速电路路设计工程师的铃流、串扰和辐射噪音等问题。
上传时间: 2013-04-24
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双足机器人是一个多自由度、多变量、非线性的复杂动力学系统。其控制平台的研究往往涉及嵌入式技术、传感器技术、步态规划、路径导航、人工智能、自动化控制等多种理论与技术,体现了信息科学和人工智能技术的最新成果,应用领域广大,具有重要的研究价值。其中,双足机器人导航控制系统是双足机器人控制平台研究中的重点和难点,将在自动驾驶、未知区域的探索、危险环境作业、核电站的维护等领域中发挥极大的作用。 本文以双足机器人导航控制系统的设计为研究背景,结合嵌入式系统开发的关键技术,主要论述了两个核心内容:一是双足机器人导航决策系统的设计。该系统是基于一种新式的ARM&DSP主从控制模式下的设计。该设计借助内外传感器系统的反馈,通过对多传感器信息的融合与处理,在导航决策算法的作用下,实现双足机器人在未知环境下平滑的自主导航。二是为增强双足机器人导航的人机交互性和控制系统对突发事件的处理能力,在基于MiniGUI的系统平台上设计了双足机器人的导航控制系统界面。论文的主要内容包括: 首先,设计了双足机器人的本体模型,并对双足机器人的步态规划做了理论研究,为步态控制获得理论上的支持。 然后,就双足机器人导航控制平台的搭建做了详细的介绍,并着重对主从控制器间通讯的CAN接口做了详细的设计。 接着,从两个层面设计了导航决策系统,一是根据内部传感器得到的关节信息,比对决策层中的步态规划算法,对关节的运动进行实时的补偿和调整,实现各关节动作的协调,得到标准的步态,保证每一步的稳定和准确。二是对外部传感器获得的外界环境信息进行处理,构建出供决策层使用的外部环境模型,之后在基于模糊神经网络的导航算法的指引下,实现双足机器人对外界环境做出合理、平滑的响应。 最后,介绍了导航控制界面的设计与实现。重点介绍了MiniGUI开发平台的搭建、基于MiniGUI的界面程序的设计以及程序在开发板上的移植,实现了控制界面在双足机器人导航上的应用。
上传时间: 2013-04-24
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DeviceNet现场总线标准作为工业现场总线的国际标准,其开放性和先进性得到了广泛关注和充分肯定。开发符合DeviceNet现场标准的自动化产品意义重大,也是必要的。 文中从现场通用的老式串口(RS232和RS485)与新兴DeviceNet网络的兼容问题以及模拟量,数字量和多种总线等多功能的一体化问题为出发点,以Atmel的32位ARM7高速处理器为开发平台,充分发挥其处理高速和功能多样的优势,同时结合DeviceNet现场总线高效和诊断的优点,开发了一个带8路数字量输入,8数字量输出,4路模拟量输入以及RS232为底层自定义协议串口,RS485为底层的在线可配置Modbus协议的DevciceNet一体化通讯网关。 最后文中还利用双口RAM的协同处理能力,构成双CPU处理能力的结构,将avr162的8位处理器处理PROFIBUS总线数据,而将32位的ARM7处理器处理DeviceNet总线数据。文中特别从系统硬件开发和软件开发两方面加以阐述,并结合OMRON PLC主站测试系统,最终成功给于测试。 为了便于读者理解和文章的完整性,本文首先对DeviceNet现场总线标准做了简单介绍;后根据DeviceNet标准对所需求的产品的进行总体设计,以及相应的DeviceNet网关的硬件和软件的设计和开发。最后,搭建了DeviceNet-Modbus测试系统和DeviceNet-PROFIBUS DP两套测试系统对所开发产品进行的了功能测试。本课题按照预期设计思想完成了DeviceNet多功能网关的软硬件的开发,并将系统程序下载到处理器中,在测试平台下能够长时间的正常运行,达到了期望效果。
上传时间: 2013-04-24
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介绍双足舵机机器人制作及方法程序,并有同时控制24路舵机方法技巧
上传时间: 2013-06-27
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在能源消耗日益增长、环境污染日渐严重的今天,在当今对可再生能源的开发利用中,风能由于其突出的优点而成为世界各国普遍重视的能源,风力发电技术也成为各国学者竞相研究的热点.而其中变速恒频风力发电技术因其高效性和实用性正受到越来越多的重视.无刷双馈电机是一种结构简单、坚固可靠、异同步通用的电机,可在无刷情况下实现双馈.它具有功率因数可调、高效率的特点,比较适用于变速恒频恒压发电系统中.该文在传统风力发电的基础上,致力于研究变速恒频风力发电技术,以作为变速恒频风力发电机用的笼型转子型式的无刷双馈电机为主要研究对象,进行了深入的研究,主要包括以下几方面:1.对国内外风力发电研究现状作了较为全面的综述,介绍了无刷双馈电机发展概况和国内外研究现状.2.研究了无刷双馈电机的原型及发展,基本结构和运行原理,电磁设计特点.解释了将无刷双馈电机应用于变速恒频风力发电的可行性和优越性.探讨了无刷双馈电机的特性.3.首次推导了适用于变速恒频风力发电无刷双馈电机的功率控制数学模型提出无刷双馈电机变速恒频风力发电系统的功率控制策略.通过仿真分析验证了模型和控制策略的正确性.4.研究了无刷双馈电机作变速恒频风力发电机运行时的定子功率绕组磁链定向矢量控制策略.5.在总结无刷双馈电机传统各种控制策略的基础上,探讨了智能控制在无刷双馈电机的应用.通过仿真分析验证了模糊功率因数控制策略的正确性.
上传时间: 2013-06-24
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磁通反向电机(FRM)是一种新型的双凸极永磁(DSPM)电机,它把高磁能的永磁体放在定子极的表面,永磁体易于安装.随着转子旋转,FRM定子绕组所交链的永磁磁通改变极性,这意味着比磁通脉振产生更大的磁通变化.由于FRM的绕组利用率高、结构简单、转动惯量小及适于高速运转等优点,可广泛应用于汽车制造业、航空航天等工业领域.本文将从模型建立、分析方法、性能分析等方面对该电机进行深入研究.首先,为了解FRM基本理论和掌握其基本规律,写出FRM的基本方程式;由于电机的双凸极结构以及饱和和非线性的影响,整个系统为一强非线性系统.对该电机作适当简化,建立其线性数学模型,这样有利于对FRM的定性分析,弄清其内部的基本电磁关系和基本特性.讨论了绕组电感、绕组磁链、感应电动势及绕组电流、电磁转矩等静态特性,推导出FRM的功率密度计算公式.其次,为准确计算FRM性能,要考虑磁路饱和、铁磁材料的非线性以及永磁磁场与电枢反应磁场之间的相互影响等因素,要建立FRM的非线性模型,提出用变网络等效磁路法进行分析.具体方法是建立FRM的非线性变网络等效磁路模型,推导等效磁路中各部分磁导的计算公式,用节点磁位法建立相应的方程,通过求解该非线性等效磁路方程,得到磁路各部分的磁通分布,进一步求得静态特性,计算出电磁参数.然后用FRM样机的实验结果验证理论分析的正确性.样机的理论分析结果同实验结果进行比较表明,本文所介绍的FRM变网络等效磁路模型具有较好的精度及通用性,基于等效磁网络模型的FRM电磁计算是可行的,计算结果是正确的.最后对磁通反向汽车发电机的功率密度进行分析.导出了磁通反向汽车发电机功率密度的计算公式,分析了影响电机功率密度的因素,并与电励磁汽车发电机进行了比较.
上传时间: 2013-07-30
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