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用VHDL语言实现半加器。已经通过编译和仿真...

📅 2013-12-30 👤 cc1915

VHDL 语言半加器仿真

wekaUT是 university texas austin 开发的基于weka的半指导学习(semi supervised learning)的分类器...

📅 2017-05-05 👤 fredguo

university supervised learning wekaUT

半整数分频器的实现（verilog），本文以6.5分频为例！很实用的！...

📅 2014-08-20 👤 pompey

verilog 整数分频器

利用两个半加器来组成的全加器，是简单的vhdl语言入门...

📅 2017-06-09 👤 leixinzhuo

半加器全加器

AVR单片机内部AD变换 AVR内部ADC转换原理： AVR单片机内部的ADC转换为10位逐次逼近型ADC。ADC与一个8通道的模拟多路复用器连接，能对来自端口A 的8 路单端输入模拟电压进行采样。单端电压输入以0V (GND) 为基准。器件还支持16 路差分电压输入组合。...

📅 2017-07-09 👤 6546544

ADC AVR 单片机变换

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