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信号产生器

  • 基于ARM的TimeToCount辐射测量仪的研究

    随着半导体工艺的飞速发展和芯片设计水平的不断进步,ARM微处理器的性能得到大幅度地提高,同时其芯片的价格也在不断下降,嵌入式系统以其独有的优势,己经广泛地渗透到科学研究和日常生活的各个方面。 本文以ARM7 LPC2132处理器为核心,结合盖革一弥勒计数管对Time-To-Count辐射测量方法进行研究。ARM结构是基于精简指令集计算机(RISC)原理而设计的,其指令集和相关的译码机制比复杂指令集计算机要简单得多,使用一个小的、廉价的ARM微处理器就可实现很高的指令吞吐量和实时的中断响应。基于ARM7TDMI-S核的LPC2132微处理器,其工作频率可达到60MHz,这对于Time-To-Count技术是非常有利的,而且利用LPC2132芯片的定时/计数器引脚捕获功能,可以直接读取TC中的计数值,也就是说不再需要调用中断函数读取TC值,从而大大降低了计数前杂质时间。本文是在我师兄吕军的《Time-To-Count测量方法初步研究》基础上,使用了高速的ARM芯片,对基于MCS-51的Time-To-Count辐射测量系统进行了改进,进一步论证了采用高速ARM处理器芯片可以极大的提高G-M计数器的测量范围与测量精度。 首先,讨论了传统的盖革-弥勒计数管探测射线强度的方法,并指出传统的脉冲测量方法的不足。然后讨论了什么是Time-To-Count测量方法,对Time-To-Count测量方法的理论基础进行分析。指出Time-To-Count方法与传统的脉冲计数方法的区别,以及采用Time-To-Count方法进行辐射测量的可行性。 接着,详细论述基于ARM7 LPC2132处理器的Time-To-Count辐射测量仪的原理、功能、特点以及辐射测量仪的各部分接口电路设计及相关程序的编制。 最后得出结论,通过高速32位ARM处理器的使用,Time-To-Count辐射测量仪的精度和量程均得到很大的提高,对于Y射线总量测量,使用了ARM处理器的Time-To-Count辐射测量仪的量程约为20 u R/h到1R/h,数据线性程度也比以前的Time-To-CotJnt辐射测量仪要好。所以在使用Time-To-Count方法进行的辐射测量时,如何减少杂质时间以及如何提高计数前时间的测量精度,是决定Time-To-Count辐射测量仪性能的关键因素。实验用三只相同型号的J33G-M计数管分别作为探测元件,在100U R/h到lR/h的辐射场中进行试验.每个测量点测量5次取平均,得出随着照射量率的增大,辐射强度R的测量值偏小且与辐射真实值之间的误差也随之增大。如果将测量误差限定在10%的范围内,则此仪器的量程范围为20 u R/h至1R/h,量程跨度近六个数量级。而用J33型G-M计数管作常规的脉冲测量,量程范围约为50 u R/h到5000 u R/h,充分体现了运用Time-To-Count方法测量辐射强度的优越性,也从另一个角度反应了随着计数前时间的逐渐减小,杂质时间在其中的比重越来越大,对测量结果的影响也就越来越严重,尽可能的减小杂质时间在Time-To-Count方法辐射测量特别是测量高强度辐射中是关键的。笔者用示波器测出此辐射仪器的杂质时间约为6.5 u S,所以在计算定时器值的时候减去这个杂质时间,可以增加计数前时间的精确度。通过实验得出,在标定仪器的K值时,应该在照射量率较低的条件下行,而测得的计数前时间是否精确则需要在照射量率较高的条件下通过仪器标定来检验。这是因为在照射量率较低时,计数前时间较大,杂质时间对测量结果的影响不明显,数据线斜率较稳定,适宜于确定标定系数K值,而在照射量率较高时,计数前时间很小,杂质时间对测量结果的影响较大,可以明显的在数据线上反映出来,从而可以很好的反应出仪器的性能与量程。实验证明了Time-To-Count测量方法中最为关键的环节就是如何对计数前时间进行精确测量。经过对大量实验数据的分析,得到计数前时间中的杂质时间可分为硬件杂质时间和软件杂质时间,并以软件杂质时间为主,通过对程序进行合理优化,软件杂质时间可以通过程序的改进而减少,甚至可以用数学补偿的方法来抵消,从而可以得到比较精确的计数前时间,以此得到较精确的辐射强度值。对于本辐射仪,用户可以选择不同的工作模式来进行测量,当辐射场较弱时,通常采用规定次数测量的方式,在辐射场较强时,应该选用定时测量的方式。因为,当辐射场较弱时,如果用规定次数测量的方式,会浪费很多时间来采集足够的脉冲信号。当辐射场较强时,由于辐射粒子很多,产生脉冲的频率就很高,规定次数的测量会加大测量误差,当选用定时测量的方式时,由于时间的相对加长,所以记录的粒子数就相对的增加,从而提高仪器的测量精度。通过调研国内外先进核辐射测量仪器的发展现状,了解到了目前最新的核辐射总量测量技术一Time-To-Count理论及其应用情况。论证了该新技术的理论原理,根据此原理,结合高速处理器ARM7 LPC2132,对以G-计数管为探测元件的Time-To-Count辐射测量仪进行设计。论文以实验的方法论证了Time-To-Count原理测量核辐射方法的科学性,该辐射仪的量程和精度均优于以前以脉冲计数为基础理论的MCS-51核辐射测量仪。该辐射仪具有量程宽、精度高、易操作、用户界面友好等优点。用户可以定期的对仪器的标定,来减小由于电子元件的老化对低仪器性能参数造成的影响,通过Time-To-Count测量方法的使用,可以极大拓宽G-M计数管的量程。就仪器中使用的J33型G-M计数管而言,G-M计数管厂家参考线性测量范围约为50 u R/h到5000 u R/h,而用了Time-To-Count测量方法后,结合高速微处理器ARM7 LPC2132,此核辐射测量仪的量程为20 u R/h至1R/h。在允许的误差范围内,核辐射仪的量程比以前基于MCS-51的辐射仪提高了近200倍,而且精度也比传统的脉冲计数方法要高,测量结果的线性程度也比传统的方法要好。G-M计数管的使用寿命被大大延长。 综上所述,本文取得了如下成果:对国内外Time-To-Count方法的研究现状进行分析,指出了Time-To-Count测量方法的基本原理,并对Time-T0-Count方法理论进行了分析,推导出了计数前时间和两个相邻辐射粒子时间间隔之间的关系,从数学的角度论证了Time-To-Count方法的科学性。详细说明了基于ARM 7 LPC2132的Time-To-Count辐射测量仪的硬件设计、软件编程的过程,通过高速微处理芯片LPC2132的使用,成功完成了对基于MCS-51单片机的Time-To-Count测量仪的改进。改进后的辐射仪器具有量程宽、精度高、易操作、用户界面友好等特点。本论文根据实验结果总结出了Time-To-Count技术中的几点关键因素,如:处理器的频率、计数前时间、杂质时间、采样次数和测量时间等,重点分析了杂质时间的组成以及引入杂质时间的主要因素等,对国内核辐射测量仪的研究具有一定的指导意义。

    标签: TimeToCount ARM 辐射测量仪

    上传时间: 2013-06-24

    上传用户:pinksun9

  • 基于ARM的超声波液位计的研制

    液位是工业生产中常见的测量参数,化工、石油、污水处理等各类工厂企业都要进行液位测量。目前,液位检测技术飞速发展,新的液位测量仪表量程大、精度高、功能全,我国新型液位仪表大多依靠进口。由于超声波测量液位具有非接触测量、可测低温介质、能够定点和连续测量等优点,近年来,超声液位测量技术取得了长足的进步,己成功应用于江河水位、化学和制药工业、食品加工、罐装液位等多种领域。 本文研制的是基于ARM的超声波液位计。传统的超声波液位计一般使用8位的单片机作处理器,采用电子元件捕捉到超声波回波信号后产生中断,判断超声波的传播时间。本文提出了使用32位ARM芯片做处理器,采用数字信号处理的方法来判断超声波传播时间的设计方案。 本文使用高性能的ARM7TDMI-S内核的芯片LPC2119作为系统的运算控制器,加强了系统对超声波回波信号的处理能力;使用A/D转换器将回波信号转换为数字信号,采用数字滤波处理信号,利用数值处理来判断超声波回波信号的起始点,提高了液位的测量精度;采用单换能器收发一体式电路设计,简化了液位的计算;利用LPC2119芯片内部的CAN总线控制器设计了CAN总线通信接口;选用一线式数字温度传感器DSl8820进行温度补偿,避免了由于环境温度的变化而产生的测量误差。ARM芯片丰富的内部资源和I/0口线有利于今后扩展功能,升级系统。本超声波液位计使用方便,精度高,能满足工业生产中的要求。

    标签: ARM 超声波液位计

    上传时间: 2013-04-24

    上传用户:lwt123

  • 基于ARM的声学海流剖面仪信号模拟器研制及回波信号处理

    随着海洋勘测技术的发展,研制高性能的海洋测流仪器越来越重要。多普勒声学海流剖面仪就是一种非常重要的用来测量海流速度的仪器。在调试多普勒声学海流剖面仪的过程中,多普勒声学海流剖面仪信号模拟器是很重要的设备,它是数字模拟技术与多普勒声学技术相结合的产物,它通过模拟的方法产生声学海流剖面仪回波信号,以便在不具备实际海洋情况的条件下,可以在实验室环境中对声学海流剖面仪的样机进行系统调试。在此情况下,本文研制了一种声学海流剖面仪信号模拟器,并对声学海流剖面仪回波信号接收过程中使用的算法进行了研究。 本文首先比较了多普勒声学海流剖面仪的发射信号与接收信号之间的关系,分析了产生多普勒频移的原因。选用直接数字频率合成技术(DDS)生成多普勒声学海流剖面仪调试所需要的回波信号o DDS技术克服了传统信号源的频率精度不高和频率不稳等问题。本文选用专用DDS芯片AD9833来实现回波信号的产生,利用ARM嵌入式技术对输出信号进行控制。 信号模拟器以S3C2410处理器为核心构建了硬件平台,采用核心板与扩展板相结合的硬件结构。核心板主要包括了存储系统、网络接口和各种通讯接口。其主要功能是存储大量数据信号和通讯功能;扩展电路包括了16路DDS信号输出及信号调理电路,可以通过软件来配置16路信号相应的工作状态及选择信号输出形式。硬件设计预留了一定数量的I/O接口以备将来扩展之用。 建立嵌入式Linux开发环境;并分析BootLoader启动机制,移植VIVI;通过配置内核相关文件,移植Linux2.4.18内核到模拟器系统;编写16路DDS的驱动程序;设计了模拟器的上位机通讯程序及用应程序;对系统进行了软硬件调试,调试结果表明模拟器完全能够模拟声学海流剖面仪的回波信号。 最后,结合回波信号形式,采用基带解调、复相关等技术对接收回波信号所使用的算法进行了研究,估算出多普勒频移,配合了调试海流剖面仪样机工作的进行。该模拟器不但可以模拟回波信号,还可以作为发射信号来用,大大提高了模拟器的实用性。关键词:声学海流剖面仪;S3C2410; AD9833;嵌入式Linux;回波信号

    标签: ARM 声学 信号模拟器 信号处理

    上传时间: 2013-04-24

    上传用户:prczsf

  • ARM环境下的通讯协议转换器的研究与开发

    本文介绍了通讯协议转换器研究的背景意义和目前国内外发展的现状,并详细叙述了所选方案的设计过程。本协议转换器的丰控制芯片采用了基于ARM7内核的32位微控制芯片LPC2212,提供了高速稳定的硬件平台。操作系统采用实时嵌入式操作系统μC/OS-Ⅱ,工作稳定,实时性强,移植方便。 本文的丰要内容如下:整体的设计思路,结构组成;系统硬件的设计,丰要包括网络接口电路,USB接口电路,以及串口扩展电路;TCP/IP协议,丰要包括TCP协议,IP协议,ARP协议等;USB协议,丰要包括USB设备构架,USB数据流模型;串口数据转以太网数据和 USB 数据以及太网数据和 USB 数据转串口数据;嵌入式实时操作系统μC/OS-Ⅱ,丰要包括信号量,消息邮箱,消息队列等;操作系统的移植,丰要包括与处理器相关的文件的改写。整个系统的硬件和底层软件部分已经完成,经串口调试软件、USB总线监测软件以及以太网数据监测软件进行实际的收发数据实验,验证了方案的合理性。 在USB和以太网驱动程序的编写中,查阅了大量的相关资料。对于USB协议,重点分析了USB协议的架构和数据流模型。对于TCP/IP协议,仔细分析了其封装和分用,分析了TCP协议、IP协议、ARP协议的原理及程序的实现。对于操作系统的移植,给出了具体的实现步骤,并给出了丰要的代码。

    标签: ARM 环境 通讯协议 转换器

    上传时间: 2013-06-10

    上传用户:f1364628965

  • 大功率DCDC变换器ARM控制系统及EMC的研究

    本文对燃料电池车用DC/DC变换器的基本原理以及控制策略进行了较为详尽的分析和讨论,对基于ARM的DC/DC变换器控制系统的软硬件设计作了较为详尽的论述,对控制系统的电磁兼容作了详细的研究并给出了提高电磁兼容能力的措施。本文介绍了本课题研究的背景,燃料电池电动汽车的特性和研究的目的与意义并分析了大功率DC/DC变换器主电路的拓扑结构、工作原理和电磁兼容环境。在此基础上,从控制电路的最小系统、检测系统、脉冲发生系统以及驱动电路、CAN通讯电路等方面重点讨论了DC/DC变换器控制系统的硬件设计以及驱动电路的设计。本文在DC/DC变换器电感电流连续状态空间小信号数学模型的基础上,应用MATLAB软件对大功率DC/DC变换器单环控制系统进行了建模和仿真分析,给出了具有实际指导意义的结论,设计了基于ARM控制系统的软件结构并编写了相应的软件代码。此外,本文从硬件和软件两个方面重点讨论了控制系统的电磁兼容以及抗干扰措施。在系统硬件和软件基础上进行了功率试验并给出了试验结果以及今后改进的方向。

    标签: DCDC ARM EMC 大功率

    上传时间: 2013-07-12

    上传用户:wao1005

  • FPGA在数字信号处理中的应用与研究

    数字信号处理是信息科学中近几十年来发展最为迅速的学科之一.目前,数字信号处理广泛应用于通信、雷达、声纳、语音与图像处理等领域.而数字信号处理算法的硬件实现一般来讲有三种方式:用于通用目的的可编程DSP芯片;用于特定目的的固定功能DSP芯片组和ASIC;可以由用户编程的FPGA芯片.随着微电子技术的发展,采用现场可编程门阵列FPGA进行数字信号处理得到了飞速发展,FPGA正在越来越多地代替ASIC和PDSP用作前端数字信号处理的运算.该文主要探讨了基于FPGA数字信号处理的实现.首先详细阐述了数字信号处理的理论基础,重点讨论了离散傅立叶变换算法原理,由于快速傅立叶变换算法在实际中得到了广泛的应用,该文给出了基-2FFT算法原理、讨论了按时间抽取FFT算法的特点.该论文对硬件描述语言的描述方法和风格做了一定的探讨,介绍了硬件描述语言的开发环境MAXPLUSII.在此基础上,该论文详细阐述了数字集成系统的高层次设计方法,讨论了数字系统设计层次的划分和数字系统的自顶向下的设计方法,探讨了数字集成系统的系统级设计和寄存器传输级设计,描述了数字集成系统的高层次综合方法.最后该文描述了数字信号处理系统结构的实现方法,指出常见的高速、实时信号处理系统的四种结构;由于FFT算法在数字信号处理中占有重要的地位,所以该文提出了用FPGA实现FFT的一种设计思想,给出了总体实现框图;重点设计实现了FFT算法中的蝶形处理单元,采用了一种高效乘法器算法设计实现了蝶形处理单元中的旋转因子乘法器,从而提高了蝶形处理器的运算速度,降低了运算复杂度.

    标签: FPGA 数字信号处理 中的应用

    上传时间: 2013-07-19

    上传用户:woshiayin

  • HDTV码流发生器内置信源解码板和基于FPGA的显示器测试信号发生器的研究

    该论文的工作主要分为两部分,第一部分是介绍与数字高清晰度电视(HDTV)码流发生器配套的信源解码板的设计与实现.信源解码板是整个码流发生器的重要组成部分,该论文在介绍相关标准MPEG-2和AC-3以及整个码流发生器功能的基础上提出了用ST公司的芯片组实现HDTV信源解码板的设计方案.论文详细分析了各个功能模块的具体设计方法以及实现时应注意的问题.目前该课题已经成功结题,各项技术指标完全符合合作单位的要求.该论文的第二部分主要是进行基于FPGA的显示器测试信号发生器的研究与开发.在对测试信号发生器所需产生的13种测试图案和所要适应的18种显示格式的介绍之后,该论文提出了以FLEX10K50为核心控制芯片的显示器测试信号发生器的设计方案.该论文详细讨论了FPGA设计中各个功能模块的划分和设计实现方法,并介绍了对FLEX10K50进行配置的方法.

    标签: HDTV FPGA 码流 发生器

    上传时间: 2013-04-24

    上传用户:yoleeson

  • FPGA在雷达信号处理中的设计与应用

      本文首先介绍了利用FPGA设计数字电路系统的流程和雷达数字信号处理的主要内容。  在第二章中主要阐述了FIR数字滤波器的窗函数设计方法,并应用FIR滤波器设计数字动目标显示和数字动目标检测系统;脉冲压缩处理是现代雷达信号处理的一个重要组成部分,线性调频信号和二相巴克码的脉冲压缩处理方法在第三章做了重点描述。  Cyclone系列芯片是高性价比,基于1.5V、0.13um采用铜制层的SRAM工艺。它是第一种支持配置数据解压的FPGA芯片。论文设计的最后部分是利用Altera公司Cyclone系列FPGA芯片EP1C6F256C6和EPCS4配置芯片设计设计SD转换器,在QuartusⅡ4.0下采用VHDL语言和逻辑电路图结合的设计方法,经过仿真并最终实现了硬件设计。  设计结果表明电路性能可靠,SD转换的精度较高,完全满足设计的要求。

    标签: FPGA 雷达信号处理 中的设计

    上传时间: 2013-06-26

    上传用户:华华123

  • 基于DSPs和FPGA的通信信号调制识别方法研究

    基于小波变换和神经网络理论,对非稳定、大信噪比(SNR)变化的通信信号进行有效的特征提取和分类,实现了通信信号调制方式的分类识别.首先,采用基于多分辨分析框架的Mallat快速算法提取离散细节作为特征采,实验得出db3小波非常适合作为特征提取小波,用小波变换大大压缩了通信信号特征矢量,提取的信号特征矢量64点;然后依据神经网络理论,分别采用BP网络作为分类器对通信信号调制识别分类.从计算机模拟实验结果可知,该方法能很好地完成通信信号调制识别分类任务,使识别正确率得到了明显改善,同时降低了识别分类过程的复杂度,并且为通信信号调制识别的DSP实现提供了快速计算的理论基础.其次,介绍了TMS320LF2407 DSP和FPGA的结构原理,并在此基础上设计了数字信号处理板和制作调试电路板.最后,用汇编和C语言编制A/D程序、串口通信程序和应用程序,并在信号处理板上调试和运行.

    标签: DSPs FPGA 通信信号 调制识别

    上传时间: 2013-07-23

    上传用户:731140412

  • 基于FPGA的机载二次雷达硬件系统

    二次雷达(Secondary Surveillance Radar)是民航空中管制(Air Traffic Control)和军事敌我识别(Identification Friend or Foe)系统中的关键部分,由于这两个应用领域都要求很高的可靠性和稳定性,因此,二次雷达一直是国内外雷达信号处理领域的研究热点.传统的机载二次雷达应答器普遍采用中小规模集成电路和分立元件设计,其稳定性和可靠性差,实时处理能力也很有限,无法完成高密度、大容量的应答.针对这些缺陷,本论文提出一种全新的应答数字信号处理器硬件结构,即FPGA+DSP的混合结构.这种硬件体系结构的特点是可靠性高,集成度高,通用性强,适于模块化设计,处理速度快,能实时处理多个应答信号,以及进行置信度分析和生成报表.此项目中,本文作者主要负责FPGA部分硬件设计.FPGA主要完成双通道数据采集、产生视频信号和旁瓣抑制信号、计算当前飞机相对本地接收天线的方位和距离、与DSP实时交换数据、上传报表等功能.论文详细分析了接收机信号处理算法在FPGA中的硬件实现方案,在提高系统可靠性、坚固性以及FPGA资源的合理利用方面做了深入的探讨.同时给出不同层次关键模块的HDL实现及其时序仿真结果.

    标签: FPGA 机载 二次雷达 硬件系统

    上传时间: 2013-04-24

    上传用户:西伯利亚狼