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·摘要： 本文详细分析了AES/EBU音频信号的编码、格式结构,结合调频同步广播激励器的设计,提出基于DSP的AES/EBU音频信号解码方案.并给出了实现方案的解码电路和程序流程.
频率计VHDL编程。设计一个4位数字显示的十进制频率计，其测量范围为1MHz，测量值通过4个数码管显示以8421BCD码形式输出，可通过开关实现量程控制，量程分10kHz、100kHz、1MHz三档(最大读数分别为9.999kHz、99.9...
课程设计要求设计并用FPGA实现一个数字频率计，具体设计要求如下： 测量频率范围： 10Hz～100KHz 精度： ΔF / F ≤ ±2 % 系统外部时钟： 1024Hz 测量波形： 方波 Vp-p ＝ 3～5 V 硬件设备：...
在需要计算的设计中，诸如：收款机、计算器等经常遇到2位小数的处理，简单的处理方法就是将数据乘以100后存储、处理，现提供一函数用于6字节除以100的n次方
分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太严格的设计，通过自主设计进行时钟分频的实...
电力设计中短路电流的计算机算法:在电力设计中，电气设备和载流导体的选择必须进行短路电流的计算。针对通常计算短路电流是以手 工形式进行的问题，提出了短路电流的计算机算法