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VHDL/FPGA/Verilog 自适应滤波器设计的仿真程序

自适应滤波器设计的仿真程序，完全用C语言编写，可以作为滤波器设计的参考。原为VHDL实验要求的程序。

https://www.eeworm.com/dl/663/209058.html

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自适应滤波器仿真程序

邮电通讯系统  对一般的PLL及APLL,定点PLL进行了MATLAB SIMULINK仿真

对一般的PLL及APLL,定点PLL进行了MATLAB SIMULINK仿真，可以由程序直接生成PLL的VHDL和C源代码

https://www.eeworm.com/dl/690/275446.html

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PLL SIMULINK MATLAB APLL

VHDL/FPGA/Verilog 状态机设计

状态机设计，用VHDL进行MEALY型状态机的设计。由于两个程序本身有延时现象，本实验进行了改进。

https://www.eeworm.com/dl/663/285421.html

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状态

微处理器开发  spi bootloader详细资料

spi bootloader详细资料，里面包含C代码和VHDL代码以及相关的说明文档，有兴趣的朋友可以下来看看。

https://www.eeworm.com/dl/655/307699.html

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bootloader spi

VHDL/FPGA/Verilog 任意小数分频器产生原理

任意小数分频器产生原理，及详细说明文档，任意数分频(包括奇偶数和小数)的设计方法(含VHDL例子)

https://www.eeworm.com/dl/663/381626.html

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小数分频器

VHDL/FPGA/Verilog SDRAM存取控制器设计书

SDRAM存取控制器设计书，包含标准的SDRAM读写控制功能，和自动刷新功能。对VHDL设计初学者很有帮助。密码MMCTEAM。

https://www.eeworm.com/dl/663/407113.html

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SDRAM 存取制器设计

汇编语言  此为等精度数字频率计的设计

此为等精度数字频率计的设计，用单片机汇编语言和VHDL语言实现准确的频率采集功能。

https://www.eeworm.com/dl/644/474024.html

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等精度数字频率计

VHDL/FPGA/Verilog 计数器

计数器，用VHDL实现，先6分频，再10分频，24分频，同时可做万年历

https://www.eeworm.com/dl/663/484748.html

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计数器

技术资料  Verilog基础知识.pdf

资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VERILOG快速入门->Verilog基础知识.pdf

https://www.eeworm.com/dl/880030.html

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Verilog 基础知识

技术资料  卡内基梅陇大学verilog课程讲义.pdf

资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->卡内基梅陇大学verilog课程讲义.pdf

https://www.eeworm.com/dl/881230.html

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