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VHDL/FPGA/Verilog 秒表可计时

秒表可计时，用VHDL编译的源代码，从0.1到60秒计时，解压后直接用Quartus打开project即可

https://www.eeworm.com/dl/663/371614.html

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计时

书籍源码  北京邮电大学的经典教材

北京邮电大学的经典教材，内含很多经典的vhdl的程序实例，是很好的参考资料

https://www.eeworm.com/dl/532/377461.html

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大学教材

VHDL/FPGA/Verilog 这是quartusII中文用户教程

这是quartusII中文用户教程，里面是vhdl等硬件语言的入门教程，希望能给有需要的朋友帮助。

https://www.eeworm.com/dl/663/434555.html

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quartusII 用户教程

其他嵌入式/单片机内容  基于I2C总线协议

基于I2C总线协议，该程序用VHDL编写了该协议的源代码，运行环境为ISE，modesim

https://www.eeworm.com/dl/687/436462.html

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I2C 总线协议

VHDL/FPGA/Verilog 实现对时钟信号的技术分频

实现对时钟信号的技术分频，程序简单易懂，对于初学VHDL者来说，提供了一个良好的方法。

https://www.eeworm.com/dl/663/441987.html

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时钟信号分频

VHDL/FPGA/Verilog 平坦度检测中的高度检测算法

平坦度检测中的高度检测算法，使用ISE开发环境，语言为VHDL，平台是XC3S400

https://www.eeworm.com/dl/663/453347.html

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检测检测算法

其他书籍  这是一部很好的教程

这是一部很好的教程，关于VHDL的。适合于初学者，如何觉得好，可以做个朋友啊。

https://www.eeworm.com/dl/542/453810.html

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教程

VHDL/FPGA/Verilog 电子设计自动化中关于交通信号的转换的实现程序

电子设计自动化中关于交通信号的转换的实现程序，基于VHDL语言实现的

https://www.eeworm.com/dl/663/458441.html

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电子设计自动化交通信号转换程序

VHDL/FPGA/Verilog 基于Quartus II的8位十六进制频率计的项目设计

基于Quartus II的8位十六进制频率计的项目设计，包含了项目文件和VHDL源代码

https://www.eeworm.com/dl/663/466976.html

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Quartus 8位十六进制频率计

其他  乘法器的实现

乘法器的实现，两种方法，调用IPcore及手动编写，基于ISE软件下的VHDL语言实现

https://www.eeworm.com/dl/534/490080.html

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乘法器

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