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技术资料 rs(15,9)编码器
verilog HDL语言实现的rs编码器,可以扩展,只需做简单的修改
技术资料 SystemVerilog3.1a语言参考手册
本资料具体讲解了system verilog 的语法规则,并有大量的实例和代码
技术资料 FPGA十分频源代码
能实现等占空比的十分频,开发环境为FPGA,语言为verilog
技术资料 基于FPGA的浮点数加法程序
基于FPGA,用verilog编写的单精度浮点数加法程序,奉献给大家!
认证考试资料 What you always wanted to know about networking but were afraid to ask! * How the Internet work
What you always wanted to know about networking but were afraid to ask!
* How the Internet works
* How e-mail, e-learning, and telephony work on the Internet
* What makes a network safe
* How traffic gets from here to there
* Disaster recovery and other ways to keep a network running
* How busines ...
VHDL/FPGA/Verilog 简单的一个8位RISC
简单的一个8位RISC,Verilog HDL代码,类型为pic16c57
VHDL/FPGA/Verilog 循环冗余校验
循环冗余校验,crc_16,主要运用在数字通信系统。用Verilog HDL编写。