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教程资料  基于cpld的pwm控制设计采用vhdl.verilog语言设计

基于cpld的pwm控制设计\r\n采用vhdl.verilog语言设计\r\n对大家比较有用

https://www.eeworm.com/dl/Protel/doc/18129.html

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单片机编程  Verilog HDL的基本知识--周立功Actel产品线

概述:数字通信和自动化控制等领域的高速度发展和世界范围的高技术竞争对数字系统提出了越来越高的要求，特别是需要设计具有实时信号处理能力的专用集成电路，要求把包括多个CPU内核在内的整个电子系统综合到一个芯片(SOC)上。&#61656;集成电路制造工艺的发展；&#61656;知识产权核(IP)的重复利用；&#61656;硬件描述语言(HDL) ...

https://www.eeworm.com/dl/502/29730.html

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Verilog Actel HDL 基本知识

教程资料  Verilog数字系统设计教程(第二版) 夏宇闻

Verilog数字系统设计教程(第二版) 夏宇闻

https://www.eeworm.com/dl/fpga/doc/32288.html

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Verilog 数字系统设计教程

可编程逻辑  Verilog数字系统设计教程(第二版) 夏宇闻

Verilog数字系统设计教程(第二版) 夏宇闻

https://www.eeworm.com/dl/kbcluoji/39335.html

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Verilog 数字系统设计教程

加密解密  DES 加密算法的VHDL和VERILOG 源程序及其TESTBENCH。

DES 加密算法的VHDL和VERILOG 源程序及其TESTBENCH。

https://www.eeworm.com/dl/519/100535.html

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TESTBENCH VERILOG VHDL DES

其他嵌入式/单片机内容  发一个基于ModelSim仿真的Verilog源代码包

发一个基于ModelSim仿真的Verilog源代码包

https://www.eeworm.com/dl/687/130423.html

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ModelSim Verilog 仿真源代码

VHDL/FPGA/Verilog 这是一个Verilog HDL编写的RISC cpu的程序

这是一个Verilog HDL编写的RISC cpu的程序，该程序共10个子程序，实现了简单的RISC cpu，可供初学者参考，学习硬件描述语言，及设计方法。该程序通过了modelsim仿真验证。

https://www.eeworm.com/dl/663/133575.html

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Verilog RISC HDL cpu

其他嵌入式/单片机内容  verilog的源代码。给出来常用的一些例程

verilog的源代码。给出来常用的一些例程，对于verilog的使用和学习都有很大的帮助作用。

https://www.eeworm.com/dl/687/137539.html

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verilog 源代码

微处理器开发  Use the verilog language write a MIPS CPU code, and have additional instruction, for example: select

Use the verilog language write a MIPS CPU code, and have additional instruction, for example: selection sort instruction. The code has contain combination circuit and sequenial circuit. CPU have contain ALU, ADD, ALU_CONTROL, DATA_MEMORY, INST_MEMORY, REGISTER, PC, and TESTBRANCH.

https://www.eeworm.com/dl/655/140828.html

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instruction additional language example

微处理器开发  一个嵌入式RISC CPU 的Verilog 设计源码

一个嵌入式RISC CPU 的Verilog 设计源码，可综合。内含详细的设计文挡。

https://www.eeworm.com/dl/655/141583.html

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Verilog RISC CPU 嵌入式

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