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VHDL/FPGA/Verilog 用Verilog HDL 写的数字示波器的源代码

用Verilog HDL 写的数字示波器的源代码，其中还包括VGA控制源代码

https://www.eeworm.com/dl/663/294630.html

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Verilog HDL 数字示波器源代码

VHDL/FPGA/Verilog altera i2c slave ip核verilog 编写

altera i2c slave ip核verilog 编写

https://www.eeworm.com/dl/663/301574.html

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verilog altera slave i2c

VHDL/FPGA/Verilog 这是一个FIFO_Buffer的verilog代码.

这是一个FIFO_Buffer的verilog代码.

https://www.eeworm.com/dl/663/314974.html

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FIFO_Buffer verilog 代码

串口编程  采用CPLD实现串口通信（Verilog硬件描述语言）

采用CPLD实现串口通信（Verilog硬件描述语言）

https://www.eeworm.com/dl/624/325054.html

下载: 116

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Verilog CPLD 串口通信硬件描述语言

VHDL/FPGA/Verilog verilog语言在maxII系列芯片上实现iic功能

verilog语言在maxII系列芯片上实现iic功能

https://www.eeworm.com/dl/663/325462.html

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verilog maxII iic 语言

VHDL/FPGA/Verilog 本程序（状态机）使用Verilog HDL语言编写

本程序（状态机）使用Verilog HDL语言编写，并通过QuestaSim仿真。

https://www.eeworm.com/dl/663/328553.html

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Verilog HDL 程序状态

VHDL/FPGA/Verilog 自己编写的一个verilog HDL小程序

自己编写的一个verilog HDL小程序，实现基本的task调用function的功能，对初学者有用。在xilinx的ISE仿真调试通过

https://www.eeworm.com/dl/663/331615.html

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verilog HDL 编写程序

VHDL/FPGA/Verilog 用Verilog语言生成7位的小m序列

用Verilog语言生成7位的小m序列，产生pn码

https://www.eeworm.com/dl/663/332903.html

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Verilog 语言序列

数据库系统  本源码是用verilog编写控制LCD——使用Quartusii

本源码是用verilog编写控制LCD——使用Quartusii，开发平台使用的是DE2开发板，可实现1602上任意字符显示

https://www.eeworm.com/dl/523/336898.html

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Quartusii verilog LCD 源码

VHDL/FPGA/Verilog 使用Verilog HDL 實現AES硬體加解密

使用Verilog HDL 實現AES硬體加解密

https://www.eeworm.com/dl/663/337486.html

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Verilog HDL AES 加解密

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