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可编程逻辑 基于Verilog HDL设计的多功能数字钟

本文利用Verilog HDL 语言自顶向下的设计方法设计多功能数字钟，突出了其作为硬件描述语言的良好的可读性、可移植性和易理解等优点，并通过Altera QuartusⅡ 4.1 和ModelSim SE 6.0 完成综合、仿真。此程序通过下载到FPGA 芯片后，可应用于实际的数字钟显示中。 关键词：Verilog HDL；硬件描述语言；FPGA Abstract: In this ...
https://www.eeworm.com/dl/kbcluoji/40390.html
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单片机开发 51的VERILOG代码！适用于Xilinx的FPGA

51的VERILOG代码！适用于Xilinx的FPGA
https://www.eeworm.com/dl/648/112822.html
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*行业应用 RS编码的源代码使用Verilog在Xinloinx平台

RS编码的源代码使用Verilog在Xinloinx平台
https://www.eeworm.com/dl/631/115479.html
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VHDL/FPGA/Verilog verilog编写的计算百分比模块

verilog编写的计算百分比模块
https://www.eeworm.com/dl/663/126523.html
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VHDL/FPGA/Verilog 用Verilog HDL实现I2C总线功能

用Verilog HDL实现I2C总线功能，对I2C总线有很大帮助
https://www.eeworm.com/dl/663/138842.html
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VHDL/FPGA/Verilog 用Verilog HDL实现I2C总线功能

用Verilog HDL实现I2C总线功能，对I2C总线有很大帮助
https://www.eeworm.com/dl/663/139271.html
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其他 verilog 实现的jtag ip模块 包括了测试程序

verilog 实现的jtag ip模块 包括了测试程序
https://www.eeworm.com/dl/534/140696.html
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VHDL/FPGA/Verilog 初学verilog HDL时 找的好资料 大家共享

初学verilog HDL时 找的好资料 大家共享
https://www.eeworm.com/dl/663/142838.html
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VHDL/FPGA/Verilog 是verilog例子。初级适用。包括了简单的例子。

是verilog例子。初级适用。包括了简单的例子。
https://www.eeworm.com/dl/663/143475.html
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VHDL/FPGA/Verilog 用Verilog HDL 语言编写的播放梁祝的程序

用Verilog HDL 语言编写的播放梁祝的程序
https://www.eeworm.com/dl/663/156456.html
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