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verilog hdl 是什么？ 的查询结果
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技术资料 基于FPGA信号发生器
基于FPGA实现的DDS信号发生器，采用Verilog编写，具备高精度频率控制和稳定输出特性，适用于通信测试与嵌入式系统开发，可直接用于生产环境的硬件设计中。
ALTERA FPGA开发软件 Synplify.Pro.v7.6.rar
Synplify Pro是一个高级综合工具。其高级综合能力可以使你看到HDL代码在各种器件（FPGA/Structed ASIC/cell-based ASIC）上实现结果而无须对代码作任何修改。从而选择最合适的方式来实现它，或选择最合适的供应商。最主要的功能还是FPGA综合。 ...
VHDL/FPGA/Verilog FPGA设计全流程：Modelsim>>Synplify.Pro>>ISE 第一章 Modelsim编译Xilinx库 第二章 调用Xilinx CORE-Generato
FPGA设计全流程：Modelsim>>Synplify.Pro>>ISE
第一章 Modelsim编译Xilinx库
第二章 调用Xilinx CORE-Generator
第三章 使用Synplify.Pro综合HDL和内核
第四章 综合后的项目执行
第五章 不同类型结构的仿真
技术资料 Synplify.Pro.v7.6.rar
Synplify Pro是一个高级综合工具。其高级综合能力可以使你看到HDL代码在各种器件（FPGA/Structed ASIC/cell-based ASIC）上实现结果而无须对代码作任何修改。从而选择最合适的方式来实现它，或选择最合适的供应商。最主要的功能还是FPGA综合。 ...
精品软件 SYNPLIFY.PRO.V7.6.RAR
Synplify Pro是一个高级综合工具。其高级综合能力可以使你看到HDL代码在各种器件（FPGA/Structed ASIC/cell-based ASIC）上实现结果而无须对代码作任何修改。从而选择最合适的方式来实现它，或选择最合适的供应商。最主要的功能还是FPGA综合。 ...
技术资料 FPGA教程、例程
LCD显示
AD采集
DA转换
I2C协议
VGA显示驱动
流水灯
俄罗斯方块
红外遥控通信
贪吃蛇
深入浅出玩转FPGa—verilog全部程序
等等
是新手学习FPGA的不二利器！
技术资料 rs232 incloudin of trx and testbench
包含UART模块及测试平台的Verilog实现，可直接用于实际通信系统开发。代码经过多个项目验证，结构清晰，适合快速集成与调试。涵盖发送、接收及对应测试用例，便于验证功能完整性。
教程资料 Cadence PSD 15.0版本功能介绍
随着PCB设计复杂程度的不断提高，设计工程师对 EDA工具在交互性和处理复杂层次化设计功能的要求也越来越高。Cadence Design Systems, Inc. 作为世界第一的EDA工具供应商，在这些方面一直为用户提供业界领先的解决方案。在 Concept-HDL15.0中，这些功能又得到了大度地提升。首先，Concept-HDL15.0，提供了交互式全局属性修改 ...