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基于实时嵌入式系统的voip系统（real time embeded system）。主要难点在实时处理语音信号。语音信号基于其自身特点，要求实时不可有延迟。本源程序基于cpu:cs4281开发，在vxworks上验证通过。现公开预研阶段的测试版本。方便初学者学习基于vxworks的语音处理技术。 ...

https://www.eeworm.com/dl/662/445004.html

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embeded system voip real

VHDL/FPGA/Verilog 此设计采用Verilog HDL硬件语言设计,在掌宇开发板上实现. 将整个电路分为两个子模块

此设计采用Verilog HDL硬件语言设计,在掌宇开发板上实现. 将整个电路分为两个子模块，一个提供同步信号（H_SYNC和V_SYNC）及像素位置信息；另一个接收像素位置信息，并输出颜色信号。这样便于进行图形修改，同时也容易实现

https://www.eeworm.com/dl/663/139899.html

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Verilog HDL 硬件语言设计开发板

VHDL/FPGA/Verilog 异步FIFO控制器的设计主要用于异步先进先出控制器的设计。所用语言Verilog HDL.

异步FIFO控制器的设计主要用于异步先进先出控制器的设计。所用语言Verilog HDL.

https://www.eeworm.com/dl/663/147616.html

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Verilog FIFO HDL 控制器

压缩解压  完整的jpeg encoder verilog code,DCT部分採用1991 IEEE transection paper,利用skew circular convolution來實現精簡電路

完整的jpeg encoder verilog code,DCT部分採用1991 IEEE transection paper,利用skew circular convolution來實現精簡電路

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convolution transection circular encoder

嵌入式/单片机编程  设计输入 ! 多种设计输入方法 – Quartus II &#8226 原理图式图形设计输入 &#8226 文本编辑 – AHDL, VHDL, Verilog &#8226 内存编辑

设计输入 ! 多种设计输入方法 – Quartus II &#8226 原理图式图形设计输入 &#8226 文本编辑 – AHDL, VHDL, Verilog &#8226 内存编辑 – Hex, Mif – 第三方工具 &#8226 EDIF &#8226 HDL &#8226 VQM – 或采用一些别的方法去优化和提高输入的灵活性: &#8226 混合设计格式 &#8226 利用LPM和宏功能模块来加速设计输入 ...

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8226 Quartus Verilog AHDL

其他书籍  本书从实际的角度介绍了硬件描述语言Verilog-HDL。通过动手实践体验其语法结构、功能等内涵

本书从实际的角度介绍了硬件描述语言Verilog-HDL。通过动手实践体验其语法结构、功能等内涵

https://www.eeworm.com/dl/542/226001.html

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Verilog-HDL 角度硬件描述语言实践

VHDL/FPGA/Verilog 一个完整的通过IIC总线控制Dallas公司的温度传感芯片DS1631采集温度数据的Verilog代码

一个完整的通过IIC总线控制Dallas公司的温度传感芯片DS1631采集温度数据的Verilog代码

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Verilog Dallas 1631 IIC

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