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ALTERA FPGA开发软件  Topweaver 1.10

Topweaver 一个很好用的ＨＤＬ设计工具，能够自动将子模块聚合成一个顶层文件，DLL/PLL资源为我们提供了很好的频率合成方法。但是一些时候人们依然通过编写HDL代码来实现时钟的分频，以实现特殊的分频系数，可调节的占空比和其它DLL/PLL不容易实现的功能。 ...

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Topweaver 1.10

技术资料  Topweaver

Topweaver 一个很好用的ＨＤＬ设计工具，能够自动将子模块聚合成一个顶层文件，DLL/PLL资源为我们提供了很好的频率合成方法。但是一些时候人们依然通过编写HDL代码来实现时钟的分频，以实现特殊的分频系数，可调节的占空比和其它DLL/PLL不容易实现的功能。 ...

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Topweaver

技术资料  Topweaver 1.10

Topweaver 一个很好用的ＨＤＬ设计工具，能够自动将子模块聚合成一个顶层文件，DLL/PLL资源为我们提供了很好的频率合成方法。但是一些时候人们依然通过编写HDL代码来实现时钟的分频，以实现特殊的分频系数，可调节的占空比和其它DLL/PLL不容易实现的功能。 ...

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Topweaver 1.10

精品软件  TOPWEAVER 1.10

Topweaver 一个很好用的ＨＤＬ设计工具，能够自动将子模块聚合成一个顶层文件，DLL/PLL资源为我们提供了很好的频率合成方法。但是一些时候人们依然通过编写HDL代码来实现时钟的分频，以实现特殊的分频系数，可调节的占空比和其它DLL/PLL不容易实现的功能。 ...

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固件

VHDL/FPGA/Verilog 简单的可配置dpll的VHDL代码。用于时钟恢复后的相位抖动的滤波有很好的效果

简单的可配置dpll的VHDL代码。用于时钟恢复后的相位抖动的滤波有很好的效果，而且可以参数化配置pll的级数。

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dpll VHDL 可配置代码

单片机开发  This program prints the C8051F124 die temperature out the hardware UART at 115200bps. This example u

This program prints the C8051F124 die temperature out the hardware UART at 115200bps. This example uses the internal 24.5MHz oscillator multiplied by 2 using the on-chip PLL (SYSCLK = 49MHz).

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This temperature C8051F124 the

技术资料  ADF4351_CN

ADF4351结合外部环路滤波器和外部参考频率使用时，可实现小数N分频或整数N分频锁相环(PLL)频率合成器。

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ADF

技术资料  MB1504

MB1504 The Fujitsu MB1504/MB1504H/MB1504L, utilizing BI-CMOS technology, is a single chip serial input PLL frequency synthesizer with pulse-swallow function.

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1504 MB

技术资料  锁相环基本原理

一个典型的锁相环（PLL ）系统，是由鉴相器（PD ），压控荡器（VCO ）和低通滤波器（LPF ）三个基本电路组成

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锁相环基本原理

技术资料  Topweaver 1.1

提供了很好的频率合成方法一个很好用的ＨＤＬ设计工具，能够自动将子模块聚合成一个顶层文件，DLL/PLL资源为我们提供了很好的频率合成方法。但是一些时候人们依然通过编写HDL代码来实现时钟的分频，以实现特殊的分频系数，可调节的占空比和其它DLL/PLL不容易实现的功能。 ...

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VHDL/FPGA/Verilog 简单的可配置dpll的VHDL代码。用于时钟恢复后的相位抖动的滤波有很好的效果

单片机开发  This program prints the C8051F124 die temperature out the hardware UART at 115200bps. This example u

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