搜索:pin二极管
找到约 1,991 项符合「pin二极管」的查询结果
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https://www.eeworm.com/dl/502/27108.html
单片机编程
实验二 流水灯实验
按下SW1按钮时,八个发光二极管(L1—L8)呈顺时针方向暗点流动;按下SW2按钮时,呈顺时针方向亮点流动;分别按下SW3、SW4按钮时,与上述流动方向相反,但效果相同;无键按下时,程序恢复初始状态,即停止运行 ...
https://www.eeworm.com/dl/663/129675.html
VHDL/FPGA/Verilog
课程设计要求设计并用FPGA实现一个数字频率计
课程设计要求设计并用FPGA实现一个数字频率计,具体设计要求如下: 测量频率范围: 10Hz~100KHz 精度: ΔF / F ≤ ±2 % 系统外部时钟: 1024Hz 测量波形: 方波 Vp-p = 3~5 V 硬件设备:Altera Flex10K10 五位数码管 LED发光二极管 编程语言:Verilog HDL / VHDL ...
https://www.eeworm.com/dl/655/286066.html
微处理器开发
F2812上有3个32位的CPU定时器
F2812上有3个32位的CPU定时器,本程序主要对CPU定时器0进行操作,100MS产生1次中断,在中断中让开发板上的L1、L3、L5、L7和L2、L4、L6、L8两组发光二极管交替闪烁。
https://www.eeworm.com/dl/518187.html
技术资料
摇摇棒资料
摇摇棒是如今流行的一种玩具,在各种聚会、节日中均见得到它的身影。本设计也追随着摇摇棒的原理,利用人眼的视觉暂留特性,通过AT89S52单片机对16只高亮度LED发光二极管进行控制, 配合手的左右摇晃就可呈现一幅完整的画面。 ...
https://www.eeworm.com/dl/900498.html
技术资料
全电压20W日光灯开关恒流源
交流市电入口接有1A保险丝FS1和抗浪涌负温度系数热敏电阻NTC。之后是 EMI滤波器,由L1、L2和CX1组成。BD1是整流全桥,内部是4个高压硅二极管。C1、C2、R1、D1~D3
https://www.eeworm.com/dl/918149.html
技术资料
红外气体传感器多光路光学系统设计
在实验研究的基础上分析了采用红外发光二极管为光源的气体传感器在设计中应考虑的几个因素。对四种设计方案进行了比较,从而提出了双光源四探测器的新型多光路光学系统设计方案。采用这种光学系统不但可以对温度、环 ...
https://www.eeworm.com/dl/836952.html
技术资料
全波精密整流电路
当山>0时,必然使集成运放的输出uo<0,从而导致二极管D2导通,D1截止,电路实现反相比例运算,输出电压当u<0时,必然使集成运放的输出uo>0,从而导致二极管D1导通D2截止,R+中电流为零,因此输出电压uo=0。u和uo的波形如图(b)所小如果设二极管的导通电压为0.7V,集成运放的开环差模放大倍数为50万倍 ...
https://www.eeworm.com/dl/840822.html
技术资料
无线超温报警检测电路图(PDF版)
本电路只用一块门电路CC4011,用普通的热敏电阻作测温元件,具有声,光报警的功能. 左侧两个门组成2HZ左右的可控振荡顺,右侧两个门组成的可控振荡器.当温度正常时,热敏电阻RT与电阻R的分压低于 与非 门的阀值电压,两组振荡器均不工作.此时绿色发光二极管发光,扬声器无声.一旦超温,RT阻值足够小,第一级 与 ...
https://www.eeworm.com/dl/cadence/doc/36668.html
教程资料
Allegro FPGA System Planner中文介绍
完整性高的FPGA-PCB系统化协同设计工具
Cadence OrCAD and Allegro FPGA System Planner便可满足较复杂的设计及在设计初级产生最佳的I/O引脚规划,并可透过FSP做系统化的设计规划,同时整合logic、schematic、PCB同步规划单个或多个FPGA pin的最佳化及layout placement,借由整合式的界面 ...
https://www.eeworm.com/dl/kbcluoji/38902.html
可编程逻辑
Allegro FPGA System Planner中文介绍
完整性高的FPGA-PCB系统化协同设计工具
Cadence OrCAD and Allegro FPGA System Planner便可满足较复杂的设计及在设计初级产生最佳的I/O引脚规划,并可透过FSP做系统化的设计规划,同时整合logic、schematic、PCB同步规划单个或多个FPGA pin的最佳化及layout placement,借由整合式的界面 ...