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技术资料  数字钟

基本的verilog HDL数字钟程序代码，有秒点闪烁，清零，调时功能

https://www.eeworm.com/dl/987190.html

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数字钟

技术资料  EDA课件

EDA技术实用教程-Verilog HDL版（第四版）课件南京林业大学

https://www.eeworm.com/dl/999162.html

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Verilog

教程资料  多个Verilog和vhdl程序例子

多个Verilog和vhdl程序例子，可以作为初学者参考实例，按照电路结构写出HDL代码

https://www.eeworm.com/dl/fpga/doc/18335.html

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VHDL/FPGA/Verilog 用verilog编写的fir滤波器程序

用verilog编写的fir滤波器程序，开发环境可以用ise quartus或active hdl等

https://www.eeworm.com/dl/663/187035.html

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verilog fir 编写滤波器

VHDL/FPGA/Verilog 多个Verilog和vhdl程序例子

多个Verilog和vhdl程序例子，可以作为初学者参考实例，按照电路结构写出HDL代码

https://www.eeworm.com/dl/663/261703.html

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Verilog vhdl 程序

VHDL/FPGA/Verilog 伪随机序列产生器－filtered 代进位反馈移位寄存器

伪随机序列产生器－filtered 代进位反馈移位寄存器，verilog hdl 原代码。

https://www.eeworm.com/dl/663/374707.html

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filtered 伪随机序列产生器进位

技术资料  （2,1,7）卷积码编码、译码Verilog源码

包含（2,1,7）卷积码编码、译码各种模块，使用Verilog hdl语言编写，还有测试文件

https://www.eeworm.com/dl/853913.html

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（2 1 7）卷积码 verilog

技术资料  FPGA

verilog_HDL建模基础，对初学者来说真正能够理解透彻建模是非常有用的，

https://www.eeworm.com/dl/980897.html

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FPGA

VHDL/FPGA/Verilog 编写testbench的超好教程

编写testbench的超好教程，网上这种资料比较少。(Kluwer) Writing Testbenches--Functional Verification of HDL Models.pdf

https://www.eeworm.com/dl/663/295745.html

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testbench 编写教程

可编程逻辑  arm源码

arm7源代码，hdl描述，可以作为设计cpu的参考，也可以理解arm的具体架构

https://www.eeworm.com/dl/508495.html