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ALTERA FPGA开发软件 Synplify.Pro.v7.6.rar
Synplify Pro是一个高级综合工具。其高级综合能力可以使你看到HDL代码在各种器件（FPGA/Structed ASIC/cell-based ASIC）上实现结果而无须对代码作任何修改。从而选择最合适的方式来实现它，或选择最合适的供应商。最主要的功能还是FPGA综合。 ...
其他书籍 Verilog and VHDL状态机设计
Verilog and VHDL状态机设计，英文pdf格式
State machine design techniques for Verilog and VHDL
Abstract : Designing a synchronous finite state Another way of organizing a state machine (FSM) is a common task for a digital logic only one logic block as shown in
engineer. This paper will discuss a var ...
VHDL/FPGA/Verilog FPGA设计全流程：Modelsim>>Synplify.Pro>>ISE 第一章 Modelsim编译Xilinx库 第二章 调用Xilinx CORE-Generato
FPGA设计全流程：Modelsim>>Synplify.Pro>>ISE
第一章 Modelsim编译Xilinx库
第二章 调用Xilinx CORE-Generator
第三章 使用Synplify.Pro综合HDL和内核
第四章 综合后的项目执行
第五章 不同类型结构的仿真
技术资料 Synplify.Pro.v7.6.rar
Synplify Pro是一个高级综合工具。其高级综合能力可以使你看到HDL代码在各种器件（FPGA/Structed ASIC/cell-based ASIC）上实现结果而无须对代码作任何修改。从而选择最合适的方式来实现它，或选择最合适的供应商。最主要的功能还是FPGA综合。 ...
技术资料 lcd12864的FPGA代码
此资源基于Verilog HDL，专为LCD12864显示屏设计的FPGA代码示例。采用模块化编程技术，确保了代码的可读性和可维护性，适用于各种嵌入式系统显示需求。该实现遵循行业标准，支持灵活配置与扩展，是学习和开发FPGA控制LCD屏幕的理想选择。 ...
技术资料 Verilog经典教程
该电子书是一本经典的Verilog HDL 教程。其中通过大量的例子把读者尤其是初学者带入FPGA，硬件描述语言的殿堂。很多例子讲得非常透彻，并且有数字电路的一些知识点补充。不需要读者再去复习基础的电路知识。
精品软件 SYNPLIFY.PRO.V7.6.RAR
Synplify Pro是一个高级综合工具。其高级综合能力可以使你看到HDL代码在各种器件（FPGA/Structed ASIC/cell-based ASIC）上实现结果而无须对代码作任何修改。从而选择最合适的方式来实现它，或选择最合适的供应商。最主要的功能还是FPGA综合。 ...
教程资料 Cadence PSD 15.0版本功能介绍
随着PCB设计复杂程度的不断提高，设计工程师对 EDA工具在交互性和处理复杂层次化设计功能的要求也越来越高。Cadence Design Systems, Inc. 作为世界第一的EDA工具供应商，在这些方面一直为用户提供业界领先的解决方案。在 Concept-HDL15.0中，这些功能又得到了大度地提升。首先，Concept-HDL15.0，提供了交互式全局属性修改 ...
可编程逻辑 Cadence PSD 15.0版本功能介绍
随着PCB设计复杂程度的不断提高，设计工程师对 EDA工具在交互性和处理复杂层次化设计功能的要求也越来越高。Cadence Design Systems, Inc. 作为世界第一的EDA工具供应商，在这些方面一直为用户提供业界领先的解决方案。在 Concept-HDL15.0中，这些功能又得到了大度地提升。首先，Concept-HDL15.0，提供了交互式全局属性修改 ...