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技术资料  基于FPGA的数字时钟

基于FPGA，用verilog编写的数字时钟程序，亲测可用，奉献给大家！

https://www.eeworm.com/dl/988443.html

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FPGA

技术资料  BASYS2板卡介绍

介绍BASYS2开发板，应用VERILOG语言对其进行功能的设计

https://www.eeworm.com/dl/995158.html

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BASYS2 板卡介绍

技术资料  fifo堆栈

VHDL Test Bench created by HDL Bencher 1.02 -- Mon Feb 05 11:59:49 2001 LIBRARY ieee; USE ieee.std_logic_1164.all; USE ieee.std_logic_unsigned.all; LIBRARY UNISIM;

https://www.eeworm.com/dl/987962.html

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fifo 堆栈

技术资料  基于FPGA的VGA显示控制器设计与图像显示

该报告简述了QuartusⅡ仿真软件的基本操作方法，同时介绍FPGA逻辑器件的相关知识和Verilog硬件描述语言的相关知识，在基于FPGA逻辑器件、QuartusⅡ仿真软件和Verilog硬件描述语言下，设计了VGA显示控制器。该VGA图象显示控制器是用模块设计并通过它们的级连实现的，具体是通过硬件电路的设计且能实现的方案来用Verilog语言 ...

https://www.eeworm.com/dl/854348.html

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fpga vga 显示控制器设计图像

行业发展研究  The use of hardware description languages (HDLs) is becoming increasingly common for designing and

The use of hardware description languages (HDLs) is becoming increasingly common for designing and verifying FPGA designs. Behavior level description not only increases design productivity, but also provides unique advantages for design verification. The most dominant HDLs today are Verilog and VHDL ...

https://www.eeworm.com/dl/692/431778.html

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increasingly description designing languages

通讯/手机编程  USB_I2C_MAC_FPGA_Code.rar

通信接口程序，使用VERILOG编写的FPGA所用的USB，I2C，MAC程序。

https://www.eeworm.com/dl/527/8785.html

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C_MAC_FPGA_Code USB_I

VHDL/FPGA/Verilog 汉明码的编结码模块

汉明码的编结码模块，用verilog写成，为Modelsim下的一个工程。

https://www.eeworm.com/dl/663/155193.html

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汉明码模块

微处理器开发  arm9 架构简单core实现

arm9 架构简单core实现，可以综合，有实现步骤和说明，verilog代码编写。

https://www.eeworm.com/dl/655/194048.html

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arm9 core 架构

VHDL/FPGA/Verilog Quartus下的RS（5

Quartus下的RS（5，3）编码器的源程序，用Verilog语言编写。

https://www.eeworm.com/dl/663/254299.html

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Quartus

VHDL/FPGA/Verilog 北航夏雨闻的Verilong课件

北航夏雨闻的Verilong课件，与夏雨闻写的Verilog数字系统设计教程配套

https://www.eeworm.com/dl/663/260745.html

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Verilong

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微处理器开发  arm9 架构简单core实现

VHDL/FPGA/Verilog Quartus下的RS（5

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