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技术资料  verilog实现I2C通信的slave模块源码状态机设位计可做I2C接口的仿真模型

verilog实现I2C通信的slave模块源码状态机设位计可做I2C接口的仿真模型//`timescale 1ns/1psmodule I2C_slv (input [6:0] slv_id,input&nbsp; &nbsp; &nbsp; &nbsp;RESET,input&nbsp; &nbsp; &nbsp; &nbsp;scl_i,&nbsp; &nbsp; &nbsp; //I2C clkinput&nbsp; &nbsp; &nbsp; &nbsp;sda_i,&nbsp; &nbsp; &nbsp; //I2C data ini ...

https://www.eeworm.com/dl/829144.html

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verilog i2c 通信 slave

VHDL/FPGA/Verilog 本程序对如何使用altera系列芯片片上ram进行实例演示

本程序对如何使用altera系列芯片片上ram进行实例演示，采用Verilog HDL语言编写，并使用modelsim与quartus联合进行功能仿真。本原码是红色逻辑开发板的试验程序，值得一看。

https://www.eeworm.com/dl/663/247464.html

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altera ram 程序如何使用

家庭/个人应用  用Altera公司的QuartusII编写的电子钟程序

用Altera公司的QuartusII编写的电子钟程序，可以下载至开发板，实现一个智能数字钟功能，计时，校时，闹钟，跑表等功能，也可用于学习verilog HDL语言与数字逻辑

https://www.eeworm.com/dl/667/267063.html

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QuartusII Altera 编写电子钟

源码  FPGA交通的设计

基于FPGA的交通灯的设计有Verilog HDL 源码，仅供参考

https://www.eeworm.com/dl/514668.html

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FPGA

技术资料  SDRAM控制器中引文对照

SDR SDRAM控制器提供了一个符合工业标准的SDR SDRAM的简单接口，该控制器可以使用Verilog HDL 或者VHDL语言来实现，同时针对Altera的APEX构架进行了优化

https://www.eeworm.com/dl/964934.html

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SDRAM 控制器对照

其他嵌入式/单片机内容  完整的I2C slave model以及spec詳附在內,適合想利用verilog開發此類傳輸的人參考

完整的I2C slave model以及spec詳附在內,適合想利用verilog開發此類傳輸的人參考

https://www.eeworm.com/dl/687/162343.html

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verilog slave model spec

其他嵌入式/单片机内容  一个QEP电路的verilog代码。输入信号是光电编码器的A相和B相信号和一个处理时钟

一个QEP电路的verilog代码。输入信号是光电编码器的A相和B相信号和一个处理时钟，输出的是计数信号和方向信号。

https://www.eeworm.com/dl/687/305936.html

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verilog QEP 电路代码

VHDL/FPGA/Verilog 用verilog编写的SPI程序,SPI芯片是AT45DB041B.文件内包含程序仿真时的截图.包括read和wirte.

用verilog编写的SPI程序,SPI芯片是AT45DB041B.文件内包含程序仿真时的截图.包括read和wirte.

https://www.eeworm.com/dl/663/369908.html

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SPI verilog wirte read

VHDL/FPGA/Verilog DW8051单片机的设计

DW8051单片机的设计，用HDL设计，详细的HDL设计

https://www.eeworm.com/dl/663/459241.html

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8051 DW 单片机

嵌入式/单片机编程  这个是在UNIX下

这个是在UNIX下，运用在集成电路设计中重要的两个步骤ＤＡ和ＤＣ．这个里面十分详细的介绍这两个软件，设计到ＵＮＩＸ的语言和Verilog HDL语言.

https://www.eeworm.com/dl/647/286032.html

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UNIX

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