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VHDL/FPGA/Verilog Verilog hdl语言 常用加法器设计

Verilog hdl语言 常用加法器设计，可使用modelsim进行仿真
https://www.eeworm.com/dl/663/386853.html
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VHDL/FPGA/Verilog Verilog hdl语言的常用除法器设计

Verilog hdl语言的常用除法器设计，可使用modelsim进行仿真
https://www.eeworm.com/dl/663/386855.html
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其他嵌入式/单片机内容 Verilog HDL编写的4条指令CPU

Verilog HDL编写的4条指令CPU
https://www.eeworm.com/dl/687/387632.html
下载: 145
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VHDL/FPGA/Verilog 次代码利用verilog HDL来描述的

次代码利用verilog HDL来描述的，可以实现2倍频功能，只是频率有一点误差。
https://www.eeworm.com/dl/663/471028.html
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VHDL/FPGA/Verilog 中文版Verilog HDL简明教程

中文版Verilog HDL简明教程，很简洁，结合实例，很容易理解，适合初学者。
https://www.eeworm.com/dl/663/474115.html
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VHDL/FPGA/Verilog Verilog HDL中关于赋值语句的ppt

Verilog HDL中关于赋值语句的ppt
https://www.eeworm.com/dl/663/481749.html
下载: 113
查看: 1057

VHDL/FPGA/Verilog 一个时钟分频模块,in verilog hdl

一个时钟分频模块,in verilog hdl
https://www.eeworm.com/dl/663/488836.html
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嵌入式/单片机编程 串口8位数据 verilog hdl提取

串口8位数据 verilog hdl提取
https://www.eeworm.com/dl/647/490589.html
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技术资料 基于Verilog-HDL语言的时钟设计

基于Verilog-HDL语言的时钟设计这是一份非常不错的资料，欢迎下载，希望对您有帮助！
https://www.eeworm.com/dl/747684.html
下载: 3
查看: 5091

技术资料 Verilog HDL 自动售票机的实现

Verilog HDL 自动售票机的实现，适合感兴趣的学习者学习.
https://www.eeworm.com/dl/833165.html
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