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VHDL/FPGA/Verilog Verilog HDL编写的CPU模型

Verilog HDL编写的CPU模型，很经典，比较通用
https://www.eeworm.com/dl/663/168050.html
下载: 71
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VHDL/FPGA/Verilog verilog ADPLL file with testbench.v

verilog ADPLL file with testbench.v
https://www.eeworm.com/dl/663/173473.html
下载: 124
查看: 1122

编辑器/阅读器 SOURCE INSIGHT的verilog语法插件

SOURCE INSIGHT的verilog语法插件，SOURCE INSIGHT支持自动完成等功能，是一个不错的硬件语言编辑分析器
https://www.eeworm.com/dl/626/180700.html
下载: 109
查看: 1328

嵌入式/单片机编程 verilog实现电子时钟模块

verilog实现电子时钟模块，输入60Hz时钟信号和复位，输出时分秒，共6位，每位7段输出用于驱动
https://www.eeworm.com/dl/647/183930.html
下载: 55
查看: 1101

VHDL/FPGA/Verilog Viterbi算法的Verilog源代码。

Viterbi算法的Verilog源代码。
https://www.eeworm.com/dl/663/184942.html
下载: 94
查看: 1085

VHDL/FPGA/Verilog master spi的源代码（verilog）

master spi的源代码（verilog），包括文档，测试程序
https://www.eeworm.com/dl/663/189590.html
下载: 90
查看: 1145

其他书籍 Verilog HDL硬件描述语言

Verilog HDL硬件描述语言，徐振林编著。pdf格式。
https://www.eeworm.com/dl/542/192381.html
下载: 44
查看: 1085

微处理器开发 intel 8088 架构的verilog代码

intel 8088 架构的verilog代码，可以综合下载，在fpga上实现8088调试。
https://www.eeworm.com/dl/655/194049.html
下载: 151
查看: 1166

其他书籍 Verilog and VHDL状态机设计

Verilog and VHDL状态机设计，英文pdf格式 State machine design techniques for Verilog and VHDL Abstract : Designing a synchronous finite state Another way of organizing a state machine (FSM) is a common task for a digital logic only one logic block as shown in engineer. This paper will discuss a var ...
https://www.eeworm.com/dl/542/200846.html
下载: 145
查看: 1083

VHDL/FPGA/Verilog verilog_hdl教程135例

verilog_hdl教程135例，源程序，有需要的可以下载
https://www.eeworm.com/dl/663/201721.html
下载: 152
查看: 1070