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VHDL/FPGA/Verilog Verilog HDL语言编写的5分频电路。采用两路时钟相逻辑作用产生。

Verilog HDL语言编写的5分频电路。采用两路时钟相逻辑作用产生。

https://www.eeworm.com/dl/663/176687.html

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Verilog HDL 语言编写

VHDL/FPGA/Verilog 一个pci接口的硬件描述语言的实现源代码,用verilog语言实现

一个pci接口的硬件描述语言的实现源代码,用verilog语言实现

https://www.eeworm.com/dl/663/182380.html

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verilog pci 接口硬件描述语言

VHDL/FPGA/Verilog 用verilog硬件描述语言编写的16位数模转换器的源代码

用verilog硬件描述语言编写的16位数模转换器的源代码，可以综合

https://www.eeworm.com/dl/663/200328.html

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verilog 硬件描述语言数模转换器源代码

VHDL/FPGA/Verilog 采用Verilog语言,实现了FPGA控制视频芯片的数据采集,并将数据按帧存储起来

采用Verilog语言,实现了FPGA控制视频芯片的数据采集,并将数据按帧存储起来

https://www.eeworm.com/dl/663/203677.html

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Verilog FPGA 语言控制

VHDL/FPGA/Verilog 基于FPGA的异步FIFO的软硬件实现,通过VERILOG编程实现后下载到FPGA芯片

基于FPGA的异步FIFO的软硬件实现,通过VERILOG编程实现后下载到FPGA芯片

https://www.eeworm.com/dl/663/211087.html

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FPGA VERILOG FIFO 软硬件

VHDL/FPGA/Verilog 用于生成GF(2^m)有限域元素求逆器的Verilog HDL源文件的C程序

用于生成GF(2^m)有限域元素求逆器的Verilog HDL源文件的C程序

https://www.eeworm.com/dl/663/247017.html

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Verilog HDL GF C程序

其他嵌入式/单片机内容  用Verilog语言实现了一个8bit的超前进位加法器

用Verilog语言实现了一个8bit的超前进位加法器，其中包括测试文件。

https://www.eeworm.com/dl/687/249174.html

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Verilog 8bit 语言加法器

单片机开发  32位RISC单片机verilog源码内包含说明文档经过他人测试通过

32位RISC单片机verilog源码内包含说明文档经过他人测试通过

https://www.eeworm.com/dl/648/254214.html

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verilog RISC 单片机源码

VHDL/FPGA/Verilog 用Verilog实现国内第一个商用密码算法SMS4的加密和解密。

用Verilog实现国内第一个商用密码算法SMS4的加密和解密。

https://www.eeworm.com/dl/663/260834.html

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Verilog SMS4 商加密

其他嵌入式/单片机内容  verilog hdl写的利用fpga控制ad7865进行多路ad数据采集的程序源代码。

verilog hdl写的利用fpga控制ad7865进行多路ad数据采集的程序源代码。

https://www.eeworm.com/dl/687/269202.html

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verilog fpga 7865 hdl

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