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VHDL/FPGA/Verilog 数据交织器 verilog HDL源文件

数据交织器 verilog HDL源文件

https://www.eeworm.com/dl/663/336410.html

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verilog HDL 数据交织器

VHDL/FPGA/Verilog verilog 实现循环冗余校验源代码

verilog 实现循环冗余校验源代码

https://www.eeworm.com/dl/663/336415.html

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verilog 循环冗余校验源代码

VHDL/FPGA/Verilog verilog HDL语言编写的数字秒表

verilog HDL语言编写的数字秒表，仿真已经通过，可供参考

https://www.eeworm.com/dl/663/339421.html

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verilog HDL 语言编写

VHDL/FPGA/Verilog verilog入门基础以及简单编程介绍

verilog入门基础以及简单编程介绍，verilog是近几年发展迅速的一门硬件语言

https://www.eeworm.com/dl/663/344658.html

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verilog 编程

VHDL/FPGA/Verilog msk的verilog程序利用ＦＰＧＡ实现

msk的verilog程序利用ＦＰＧＡ实现

https://www.eeworm.com/dl/663/346231.html

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verilog msk 程序

VHDL/FPGA/Verilog ofdm的verilog程序利用ＦＰＧＡ实现

ofdm的verilog程序利用ＦＰＧＡ实现

https://www.eeworm.com/dl/663/346232.html

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verilog ofdm 程序

VHDL/FPGA/Verilog cordic的verilog程序用ＦＰＧＡ实现

cordic的verilog程序用ＦＰＧＡ实现

https://www.eeworm.com/dl/663/346234.html

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verilog cordic 程序

微处理器开发  verilog语言实现交通灯

verilog语言实现交通灯，farm road和highway的十字路口，若农场路上检测到车，高速路上交通灯由绿变黄变红，农场路交通灯变绿。农场路上绿灯时间有上限，而高速路上绿灯时间有下限。包含.v文件和测试用.vwf文件

https://www.eeworm.com/dl/655/347667.html

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verilog 语言交通灯

VHDL/FPGA/Verilog 用Verilog 实现的电子时钟

用Verilog 实现的电子时钟，给初学者一个模版，学习Verilog。

https://www.eeworm.com/dl/663/348974.html

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Verilog 电子时钟

VHDL/FPGA/Verilog Verilog语言编写的电话计费系统

Verilog语言编写的电话计费系统，这只是源代码，需要在quartusII等软件下运用

https://www.eeworm.com/dl/663/352155.html

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Verilog 语言编写电话

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