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技术书籍  VHDL 程序设计

·VHDL 程序设计  

https://www.eeworm.com/dl/537/14813.html

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VHDL/Verilog/EDA源码  基于VHDL波形信号发生器

基于VHDL波形信号发生器,含有quartus工程文件。可以直接运行。

https://www.eeworm.com/dl/504/15064.html

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VHDL/Verilog/EDA源码  6进制计数器VHDL程序

6进制计数器VHDL程序 --文件名：counter6.vhd。 --功能：6进制计数器，有进位C

https://www.eeworm.com/dl/504/16120.html

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VHDL/Verilog/EDA源码  10进制计数器VHDL程序

10进制计数器VHDL程序 --文件名：counter10.vhd。 --功能：10进制计数器，有进位C

https://www.eeworm.com/dl/504/16121.html

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VHDL/Verilog/EDA源码  24进制计数器VHDL程序

24进制计数器VHDL程序 --文件名：counter24.vhd。 --功能：24进制计数器。

https://www.eeworm.com/dl/504/16122.html

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技术书籍  用VHDL语言实现的基于FPGA的交换机设计

用VHDL语言实现的基于FPGA的交换机设计

https://www.eeworm.com/dl/537/16145.html

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VHDL/Verilog/EDA源码  异步通信起始位正确检测的VHDL实现

异步通信起始位正确检测的VHDL实现，图式基本格式，详解设计过程。

https://www.eeworm.com/dl/504/16410.html

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教程资料  本文介绍了如何用VHDL进行DDS的设计

本文介绍了如何用VHDL进行DDS的设计，其中关键的相位累加器，正弦信号发生器等用VHDL描述

https://www.eeworm.com/dl/fpga/doc/17481.html

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教程资料  FPGA64的VHDL源代码

VHDL source codes of the FPGA64, a fpga implementation of the C64 computer. Version for the c-one fpga board.

https://www.eeworm.com/dl/fpga/doc/17492.html

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教程资料  基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计

基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计,并在EDA(电子设计自动化) 工具的帮助下,用大规模可编程逻辑器件(FPGA/ CPLD) 实现数字频率计的设计原理及相关程序

https://www.eeworm.com/dl/fpga/doc/17512.html

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