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https://www.eeworm.com/dl/684/172851.html 软件设计/软件工程

VHDL中IP核之参数化加减法器中文使用介绍

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#VHDL #IP核 #参数 #减法器

https://www.eeworm.com/dl/663/175328.html VHDL/FPGA/Verilog

用FPGA模拟VGA时序、模拟PS/2总线的键盘接口VHDL源代码

用FPGA模拟VGA时序、模拟PS/2总线的键盘接口VHDL源代码，基于Xilinx spartan3

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#FPGA #VHDL #VGA #模拟

https://www.eeworm.com/dl/663/175563.html VHDL/FPGA/Verilog

vhdl的一个串行序列信号发生器的设计与实现

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#vhdl #串行 #序列信号 #发生器

https://www.eeworm.com/dl/663/175654.html VHDL/FPGA/Verilog

利用扫描加记数程序实现百进制,适合VHDL的初学者使用.

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#VHDL #记数 #程序 #初学者

https://www.eeworm.com/dl/663/179548.html VHDL/FPGA/Verilog

用VHDL语言编写的LED显示器驱动电路的设计源程序

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#VHDL #LED #语言 #编写

https://www.eeworm.com/dl/663/180232.html VHDL/FPGA/Verilog

mcs51的vhdl IP核,是每个学习FPGA的必经之路

mcs51的vhdl IP核,是每个学习FPGA的必经之路，希望一起探讨

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#FPGA #vhdl #mcs #51

https://www.eeworm.com/dl/663/183952.html VHDL/FPGA/Verilog

一个在spantan3上实现的24路分频VHDL程序

一个在spantan3上实现的24路分频VHDL程序，实现方法简单，并且在硬件电路上跑过，可以直接使用。可以进一步修改成PWM程序。

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#spantan3 #VHDL #分频 #程序

https://www.eeworm.com/dl/663/190476.html VHDL/FPGA/Verilog

驱动模数转换器ADC0809转换的VHDL代码

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#0809 #VHDL #ADC #驱动

https://www.eeworm.com/dl/663/199924.html VHDL/FPGA/Verilog

用一片CPLD实现数字锁相环,用VHDL或V语言.

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#CPLD #VHDL #数字锁相环 #语言

https://www.eeworm.com/dl/663/199925.html VHDL/FPGA/Verilog

用一片CPLD实现数字锁相环,用VHDL或V语言.

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#CPLD #VHDL #数字锁相环 #语言