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精品软件 DSP BUILDER 10.10
对于CPLD、FPGA和HardCopy? ASIC设计，Quartus? II软件10.1是业界性能和效能首屈一指的软件，现在可以下载。这一最新版软件引入了Qsys，它是功能强大的系统集成新工具。在Quartus II订购版软件10.1中以beta版的形式提供Qsys，它提高了系统开发速度，支持设计重用，从而缩短了FPGA设计过程，减轻了工作量。 ...
集成开发环境 QuartusII Web Edtition 10.1 0
"Quartus II设计软件是Altera提供的完整的多平台设计环境，能够直接满足特定设计需要， 为可编程芯片系统（SOPC）提供全面的设计环境。"
VHDL/FPGA/Verilog 基于DE2实验板
基于DE2实验板，Quartus6.0开发环境，驱动两行液晶，其中分频值可以设置的更小一些，调试成功，编译下载即可。
VHDL/FPGA/Verilog 用VHDL编译的源代码
用VHDL编译的源代码，4bit加一器，输入一个4位二进制数自动加一，解压后直接用Quartus打开project即可
VHDL/FPGA/Verilog 给出了数字跑表的源代码
给出了数字跑表的源代码，设计了分频模块，实现了真实的时间计数，通过这个工程的训练，能更好的了解Quartus II数字电路开发的过程。
精品软件 QUARTUSII WEB EDTITION 10.1 0
"Quartus II设计软件是Altera提供的完整的多平台设计环境，能够直接满足特定设计需要， 为可编程芯片系统（SOPC）提供全面的设计环境。"
VHDL/FPGA/Verilog 内附多路选择器
内附多路选择器，74系列芯片VHDL源码，加法器，FIR，比较器等大量例子，对初学VHDL语言很有好处。可用maxplus，quartus，synplicity等综合软件进行调试
技术资料 FPGA贪吃蛇游戏源码
作者自编，贪吃蛇游戏源码。
键盘上下左右，控制贪吃蛇，VGA显示器输出。实现游戏基本逻辑和功能。
在quartus软件，cycloneIII型下实验成功
VHDL/FPGA/Verilog 该源码为用VHDL（硬件描述语言）编写的100个实例的源代码
该源码为用VHDL（硬件描述语言）编写的100个实例的源代码，是学习VHDL的绝好资源。软件环境为maxplus10.2及以上版本或Quartus2。