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技术资料  基于FPGA的频率计

基于altera 的cyclone 做的频率计源码，使用的是verilog进行编写，eda工具是quartus ii 12.0

https://www.eeworm.com/dl/870783.html

下载: 2

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cyclone verilog quartus

VHDL/FPGA/Verilog ALTERA NIOS处理器

ALTERA NIOS处理器，VHDL语言在QUARTUS编译通过，然后有C语言在NIOS SHELL下驱动，实验音频解码

https://www.eeworm.com/dl/663/140651.html

下载: 106

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ALTERA NIOS 处理器

VHDL/FPGA/Verilog vhdl编写的一个完整工程

vhdl编写的一个完整工程，对于quartus初学者可以感受一下FPGA开发的整体。

https://www.eeworm.com/dl/663/309860.html

下载: 42

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vhdl 编写工程

VHDL/FPGA/Verilog 正弦波信号发生的源码

正弦波信号发生的源码，有详细文档说明在quartus上创建工程到仿真、下载的步步操作

https://www.eeworm.com/dl/663/339594.html

下载: 101

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正弦波信号发生源码

VHDL/FPGA/Verilog 秒表可计时

秒表可计时，用VHDL编译的源代码，从0.1到60秒计时，解压后直接用Quartus打开project即可

https://www.eeworm.com/dl/663/371614.html

下载: 129

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计时

VHDL/FPGA/Verilog 实现交通灯的vhdl程序

实现交通灯的vhdl程序，可在quartus里运行，这是一个平时实验课中场遇到的小程序。

https://www.eeworm.com/dl/663/471145.html

下载: 60

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vhdl 交通灯程序

技术资料  基于VHDL的FPGA和NiosII实例精炼

本书分四个部分：Quartus II软件的基本操作、VHDL语法介绍、FPGA设计实例和Nios II设计实例。

https://www.eeworm.com/dl/867875.html

下载: 3

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FPGA VHDL NiosII

其他  这是我们做的一个作业摸60计数器

这是我们做的一个作业摸60计数器，用Quartus ii 做的，内容齐全不可不看。

https://www.eeworm.com/dl/534/175256.html

下载: 172

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计数器

VHDL/FPGA/Verilog 频率计源代码

频率计源代码，性能很好，verilog写的，顶层原理图，底层语言写的，效果很好，开发环境为quartus

https://www.eeworm.com/dl/663/202736.html

下载: 29

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频率计源代码

VHDL/FPGA/Verilog VHDL硬件描述

VHDL硬件描述，使用环境为Quartus2 6.1 分别为16进制及60进制计数器的源代码

https://www.eeworm.com/dl/663/302044.html

下载: 69

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VHDL 硬件

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