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分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太严格的设计，通过自主设计进行时钟分频的实现方法仍然非常流行。首先这种方法可以节省锁相环资源，再者，这种方式只消耗不多的逻辑单 ...

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altera FPGA PLL 分频器

VHDL/FPGA/Verilog 数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用。与传统的模拟电路实现的PLL相比

数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用。与传统的模拟电路实现的PLL相比，DPLL具有精度高、不受温度和电压影响、环路带宽和中心频率编程可调、易于构建高阶锁相环等优点。

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DPLL PLL 数字锁相环数字通信

微处理器开发  samsung推出的s3c2410 soc(可以说是公板)芯片的完整测试代码(官方),外围设备包括ADC,Timer,RTC,IIC,IIS,SPI以及系统的DMA,PLL,Power等.对需要写so

samsung推出的s3c2410 soc(可以说是公板)芯片的完整测试代码(官方),外围设备包括ADC,Timer,RTC,IIC,IIS,SPI以及系统的DMA,PLL,Power等.对需要写soc芯片底层驱动的朋友比较有帮助

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samsung s3c2410 Timer Power

技术资料  TDA8752B锁相环参数计算方法及参数设定软件的使用

1. METHOD TO FIND THE PLL PARAMETERS:...............................................................

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8752B 8752

技术资料  高频接收器和发射器的锁相环一

第一部分将重点介绍有关PLL的基本概念，同时描述基本PLL架构和工作原理，另外，我们还将举例说明PLL在通信系统中的用途。最后，我们将展示一种运用ADF4111频率合成器和VCO190-902T电压控制振荡器的实用PLL电路。

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锁相环通信系统频率合成器电压控制振荡器

技术资料  ADF4159驱动参考代码

ADI的PLL芯片ADF4159驱动参考代码

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PLL ADF4159

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单片机开发  C51的基于KST-CD111LVD-100 car tuner Driver PLL LC72131 & LA1787 的数字调谐系统

单片机开发  本文件是延时测试程序；LED灯每隔1秒亮1秒使用外部22.1184MHz晶振, * 应用PLL倍频到100MHZ.

单片机开发  AV系统数字调谐PLL频率合成器的单片机控制文章利用LC7218PLL频率合成器在AV领域的电调谐功能,提出了一个TV/FM/AM全景接收机设计方案,重点设计分析了LC7218与单片机之间的I/O

其他书籍  这样做的目的是要说明的应用提供电子系统设计师的必要工具设计和评估锁相环（ PLL ）的配置集成电路。

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