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VHDL/FPGA/Verilog verilog中调用门级电路的实验程序
verilog中调用门级电路的实验程序，实现了门级舰模
技术资料 《模拟电子技术》童诗白
这个只要学过模电的都不用说了，有需要的可以看看。
技术资料 H.263编解码源文件
·详细说明：H.263编解码源文件 内容翔实 是标准模
技术资料 模拟电路之Bible
模电经典，称为模拟电路之Bible！！！集成模拟电路的分析与设计
技术资料 时钟芯片DS1302软件
实时时钟模DS1302程序列子，时间的读取和写入
VC书籍 提取 Mozilla Thunderbird 邮件格式数据
提取 Mozilla Thunderbird 邮件格式数据，可以按时间取，结果存放于一个文件里面。采用纯c语言编写。
系统设计方案 银行排队系统的VHDL程序实现
银行排队系统的VHDL程序实现，可以实现排队顾客自动取号，查看前面排队人数，银行服务柜台号等。