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技术资料  Allegro中文教程

Allegro中文教程中兴通讯EDA工具手册，有需要的可以看看

https://www.eeworm.com/dl/877082.html

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Allegro 教程

技术资料  PSIM

该软件是EDA方面基本软件，可以实现电路设计与仿真

https://www.eeworm.com/dl/986091.html

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PSIM

嵌入式/单片机编程  以实用电子技术为主,内容涵盖电子设计与制作,EDA软件应用,电子工艺,电子元器件等方面,同时它还白日做梦部分设计原文件,譬如原程序,软件流程图,电原理图,等方便大家学习利用之四

以实用电子技术为主,内容涵盖电子设计与制作,EDA软件应用,电子工艺,电子元器件等方面,同时它还白日做梦部分设计原文件,譬如原程序,软件流程图,电原理图,等方便大家学习利用之四

https://www.eeworm.com/dl/647/272747.html

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EDA 软件电子技术电子工艺

VHDL/FPGA/Verilog 本文主要讨论了使用EDA工具设计汉字滚动显示器的技术问题。文中首先描述了基于现场可编程门阵列（FPGA）的硬件电路；然后研究了在8×8LED发光二极管点阵上显示滚动汉字的原理

本文主要讨论了使用EDA工具设计汉字滚动显示器的技术问题。文中首先描述了基于现场可编程门阵列（FPGA）的硬件电路；然后研究了在8×8LED发光二极管点阵上显示滚动汉字的原理，并给出了基于ALTERA的参数化模型库LPM描述其功能的VHDL语言程序设计；最后对使用EDA工具软件加工被显示数据文件的方法进行了讨论。 ...

https://www.eeworm.com/dl/663/305658.html

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8LED FPGA EDA 汉字

其他  本文介绍一种利用 EDA技术和VHDL 语言 ,在MAX+PLUSⅡ环境下,设计了一种新型的智能密码锁。它体积小、功耗低、价格便宜、安全可靠,维护和升级都十分方便,具有较好的应用前景

本文介绍一种利用 EDA技术和VHDL 语言 ,在MAX+PLUSⅡ环境下,设计了一种新型的智能密码锁。它体积小、功耗低、价格便宜、安全可靠,维护和升级都十分方便,具有较好的应用前景

https://www.eeworm.com/dl/534/322433.html

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VHDL PLUS EDA MAX

VHDL/FPGA/Verilog 基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计,并在EDA(电子设计自动化) 工具的帮助下,用大规模可编程逻辑器件(FPGA/ CPLD) 实现数字频率计的设计原理及相关程序

基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计,并在EDA(电子设计自动化) 工具的帮助下,用大规模可编程逻辑器件(FPGA/ CPLD) 实现数字频率计的设计原理及相关程序

https://www.eeworm.com/dl/663/490818.html

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FPGA CPLD VHDL EDA

技术资料  QuartusII　Subscription Edition　10.1

EDA工具，QuartusII 与 MAX+PlusII 都是Altera专为其产品(hardware device)，所提供的EDA Tool。它可以执行HDL的编辑(Editor and syntax check) -->模拟(Simulator) -->合成(Synthesis) -->FPGA佈局 -->Netlist download to CPLD / FPGA。

https://www.eeworm.com/dl/877256.html

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Subscription QuartusII Edition

单片机开发  lcd 与C51 的驱动程序 1、本实验箱采用的液晶显示屏内置控制器为SED1520

lcd 与C51 的驱动程序 1、本实验箱采用的液晶显示屏内置控制器为SED1520，点阵为122x32，由两片SED1520组成，由E1、E2分别选通，控制显示屏的左右两半屏。

https://www.eeworm.com/dl/648/130072.html

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1520 lcd C51 SED

单片机开发  用汇编语言编写的6位8段数码管显示程序与MS-51单片机实验系统配合使用

用汇编语言编写的6位8段数码管显示程序与MS-51单片机实验系统配合使用

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51 MS 汇编语言 8段数码管

VHDL/FPGA/Verilog 大学vhdl语言实验大全,基于max-plus2平台,内有8-3译码器,8位加法器,数字钟

大学vhdl语言实验大全,基于max-plus2平台,内有8-3译码器,8位加法器,数字钟，数码显示，74ls138，8，4位计数器，d，rs触发器，加法器，交通灯等，此原码基于长江大学可编程器件实验箱,如要运行在其他平台上需要重新定义管脚

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max-plus vhdl 大学加法器

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