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共 8 条结果

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VHDL/FPGA/Verilog verilog ADPLL file with testbench

verilog ADPLL file with testbench
https://www.eeworm.com/dl/663/362553.html
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VHDL/FPGA/Verilog verilog ADPLL file with testbench

verilog ADPLL file with testbench
https://www.eeworm.com/dl/663/362560.html
下载: 82
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VHDL/FPGA/Verilog verilog ADPLL file with testbench.v

verilog ADPLL file with testbench.v
https://www.eeworm.com/dl/663/173473.html
下载: 124
查看: 1122

VHDL/FPGA/Verilog ADPLL of high level phase locked loop

ADPLL of high level phase locked loop
https://www.eeworm.com/dl/663/374918.html
下载: 97
查看: 1107

其他 A high-speed variable phase accumulator for an ADPLL architecture

A high-speed variable phase accumulator for an ADPLL architecture
https://www.eeworm.com/dl/534/374925.html
下载: 126
查看: 1130

VHDL/FPGA/Verilog 全数字锁相环（adpll)的部分源程序代码

全数字锁相环（adpll)的部分源程序代码，是其中最重要的部分。
https://www.eeworm.com/dl/663/485423.html
下载: 73
查看: 1144

技术资料 关于Pll的文献

关于ADPLL的一些好的文献，供大家参考！
https://www.eeworm.com/dl/950594.html
下载: 2
查看: 8520

技术资料 一种改进的全数字锁相环设计

本文在介绍了经典全数字锁相环（all digital PLL, ADPLL）的基础上，提出了具有捕获锁定未知输入信号频率功能的ADPLL，使用方便，应用广泛。本文详尽的描述了系统的工作原理和关
https://www.eeworm.com/dl/919625.html
下载: 4
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